参数资料
型号: ADSP-BF506BSWZ-4F
厂商: Analog Devices Inc
文件页数: 43/80页
文件大小: 0K
描述: IC DSP 400MHZ 1.4V 120LQFP
视频文件: Blackfin? BF50x Processor Family
标准包装: 1
系列: Blackfin®
类型: 定点
接口: CAN,EBI/EMI,I²C,IrDA,PPI,SPI,SPORT,UART/USART
时钟速率: 400MHz
非易失内存: 闪存(16MB)
芯片上RAM: 68kB
电压 - 输入/输出: 3.30V
电压 - 核心: 1.29V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 120-LQFP 裸露焊盘
供应商设备封装: 120-LQFP-EP(14x14)
包装: 托盘
Rev. A
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July 2011
ADSP-BF504/ADSP-BF504F/ADSP-BF506F
JTAG Test And Emulation Port Timing
Table 42 and Figure 31 describe JTAG port operations.
Table 42. JTAG Port Timing
Parameter
V
DDEXT = 1.8 V
V
DDEXT = 2.5 V/3.3 V
Min
Max
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
4
ns
tHTAP
TDI, TMS Hold After TCK High
4
ns
tSSYS
System Inputs Setup Before TCK High1
44ns
tSTWI
TWI System Inputs Setup Before TCK High
2
n/a
5
ns
tHSYS
System Inputs Hold After TCK High
55ns
tTRSTW
TRST Pulse Width
3 (measured in TCK cycles)
4
TCK
Switching Characteristics
tDTDO
TDO Delay from TCK Low
10
ns
tDSYS
System Outputs Delay After TCK Low4
12
ns
1 Applies to System Inputs = PF15–0, PG15–0, PH2–0, NMI, BMODE3–0, RESET.
2 Applies to TWI System Inputs = SCL, SDA. For SDA and SCL system inputs, the system design must comply with VDDEXT and VBUSTWI voltages specified for the default
TWI_DT (000) setting in Table 13.
3 50 MHz Maximum
4 System Outputs = EXTCLK, SCL, SDA, PF15–0, PG15–0, PH2–0.
Figure 31. JTAG Port Timing
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tTCK
tSTAP
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
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