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参数资料
| 型号： | ADSP-BF522KBCZ-4C2 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 13/36页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTRLR 400MHZ 289CSPBGA |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | DMA，I²C，PPI，SPI，SPORT，UART |
| 时钟速率： | 400MHz |
| 非易失内存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 电压 - 输入/输出： | 1.8V，2.5V，3.3V |
| 电压 - 核心： | 1.30V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 289-LFBGA，CSPBGA |
| 供应商设备封装： | 289-CSPBGA（12x12） |
| 包装： | 托盘 |
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Rev. A
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March 2010
ADSP-BF522C/ADSP-BF523C/ADSP-BF524C/ADSP-BF525C/ADSP-BF526C/ADSP-BF527C
Table 11. Register 7 Digital Audio I/F
Bit Name
Bits
Description
Settings
BCLKINV
B7
CODEC_BCLK inversion control
0 = CODEC_BCLK not inverted (default)
1 = CODEC_BCLK inverted
MS
B6
Master mode enable
0 = enable slave mode (default)
1 = enable master mode
LRSWAP
B5
Swap DAC data control
0 = output left- and right-channel data as normal (default)
1 = swap left- and right-channel DAC data in audio interface
LRP
B4
Polarity control for clocks in right-justified,
left-justified, and I2S modes
0 = normal DACLRC and ADCLRC (default),
or processor Submode 1
1 = invert DACLRC and ADCLRC polarity, or processor Submode 2
WL [1:0]
B[3:2] Data-word length control
00 = 16 bits
01 = 20 bits
10 = 24 bits (default)
11 = 32 bits
FORMAT [1:0]
B[1:0] Digital audio input format control
00 = right justified
01 = left justified
10 = I2S mode (default)
11 = processor mode
Table 12. Register 8 Sampling Rate
Bit Name
Bits
Description
Settings
CLKODIV2
B7
CODEC_CLKOUT divider select
0 = CODEC_CLKOUT is codec clock (default)
1 = CODEC_CLKOUT is codec clock divided by 2
CLKDIV2
B6
Codec clock divide select
0 = codec clock is CODEC_MCLK (default)
1= codec clock is CODEC_MCLK divided by 2
SR [3:0]
B[5:2]
Clock setting condition
See Table 1 on Page 9 and Table 2 on Page 10
BOSR
B1
Base oversampling rate
USB mode:
0 = support for 250 × fS based clock (default)
1 = support for 272 × fS based clock
Normal mode:
0 = support for 256 × fS based clock (default)
1 = support for 384 × fS based clock
USB
B0
USB mode select
0 = normal mode enable (default)
1 = USB mode enable
Table 13. Register 9 Active
Bit Name
Bit
Description
Settings
ACTIVE
B0
Digital core activation control
0 = disable digital core (default)
1 = activate digital core
Table 14. Register 10 Software Reset
Bit Name
Bit
Description
Settings
RESET [8:0] B[8:0] Write all 0s to this register to set all registers to their default settings.
Other data written to this register has no effect.
0 = reset (default)
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| ADSP-BF523KBCZ-5 | 功能描述:IC DSP 16BIT 533MHZ 289-CSPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:Blackfin® 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
| ADSP-BF523KBCZ-5C2 | 功能描述:IC DSP 16BIT 533MHZ 289CSPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:Blackfin® 标准包装:40 系列:TMS320DM64x, DaVinci™ 类型:定点 接口:I²C，McASP，McBSP 时钟速率:400MHz 非易失内存:外部 芯片上RAM:160kB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:0°C ~ 90°C 安装类型:表面贴装 封装/外壳:548-BBGA，FCBGA 供应商设备封装:548-FCBGA（27x27） 包装:托盘 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA |
| ADSP-BF523KBCZ-6 | 功能描述:IC DSP 16BIT 600MHZ 289-CSPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:Blackfin® 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
| ADSP-BF523KBCZ-6A | 功能描述:IC DSP CTRLR 16B 600MHZ 208BGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:Blackfin® 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
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