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参数资料
| 型号： | ADSP-BF592KCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 29/44页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTRLR 64LFCSP |
| 视频文件： | Blackfin? BF592 Introduction |
| 特色产品： | Blackfin Embedded Processor |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | I²C，I²S，IrDA，PPI，SPI，SPORT，UART |
| 时钟速率： | 400MHz |
| 非易失内存： | ROM（64 kB） |
| 芯片上RAM： | 64kB |
| 电压 - 输入/输出： | 1.8V，2.5V，3.3V |
| 电压 - 核心： | 1.29V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
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Rev. B
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July 2013
JTAG Test And Emulation Port Timing
Table 31. JTAG Port Timing
Parameter
VDDEXT
1.8V Nominal
VDDEXT
2.5 V/3.3V Nominal
Min
Max
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
4
ns
tHTAP
TDI, TMS Hold After TCK High
4
ns
tSSYS
System Inputs Setup Before TCK High1
45ns
tHSYS
System Inputs Hold After TCK High1
55ns
tTRSTW
TRST Pulse Width2 (measured in TCK cycles)
4
TCK
Switching Characteristics
tDTDO
TDO Delay from TCK Low
10
ns
tDSYS
System Outputs Delay After TCK Low
3
13
ns
1 System inputs = SCL, SDA, PF15–0, PG15–0, PH2–0, TCK, NMI, BMODE3–0, PG.
2 50 MHz maximum.
3 System outputs = CLKOUT, SCL, SDA, PF15–0, PG15–0, PH2–0, TDO, EMU, EXT_WAKE.
Figure 24. JTAG Port Timing
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tTCK
tSTAP
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
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