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参数资料
| 型号： | ADUC7020BCPZ62-RL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 10/104页 |
| 文件大小： | 0K |
| 描述： | IC MCU 12BIT 1MSPS UART 40-LFCSP |
| 标准包装： | 750 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心处理器： | ARM7 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 44MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | PLA，PWM，PSM，温度传感器，WDT |
| 输入/输出数： | 14 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 32 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 数据转换器： | A/D 5x12b; D/A 4x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 40-VFQFN 裸露焊盘，CSP |
| 包装： | 带卷 (TR) |
| 配用： | EVAL-ADUC7020QSZ-ND - KIT DEV ADUC7020 QUICK START EVAL-ADUC7020MKZ-ND - KIT MINI DEV FOR ADUC7020 |
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Data Sheet
ADuC7019/20/21/22/24/25/26/27/28/29
Rev. F | Page 13 of 104
TIMING SPECIFICATIONS
Table 2. External Memory Write Cycle
Parameter
Min
Typ
Max
Unit
UCLK
tMS_AFTER_CLKH
0
4
ns
tADDR_AFTER_CLKH
4
8
ns
tAE_H_AFTER_MS
CLK
tAE
(XMxPAR[14:12] + 1) × CLK
tHOLD_ADDR_AFTER_AE_L
CLK + (!XMxPAR[10]) × CLK
tHOLD_ADDR_BEFORE_WR_L
(!XMxPAR[8]) × CLK
tWR_L_AFTER_AE_L
CLK + (!XMxPAR[10] + !XMxPAR[8]) × CLK
tDATA_AFTER_WR_L
8
12
ns
tWR
(XMxPAR[7:4] + 1) × CLK
tWR_H_AFTER_CLKH
0
4
ns
tHOLD_DATA_AFTER_WR_H
(!XMxPAR[8]) × CLK
tBEN_AFTER_AE_L
CLK
tRELEASE_MS_AFTER_WR_H
(!XMxPAR[8] + 1) × CLK
04
95
5-
0
52
CLK
tMS_AFTER_CLKH
tAE_H_AFTER_MS
tAE
tWR_L_AFTER_AE_L
MSx
AE
WS
RS
AD[16:1]
FFFF
9ABC
5678
9ABE
1234
BLE
BHE
A16
tWR
tWR_H_AFTER_CLKH
tHOLD_DATA_AFTER_WR_H
tHOLD_ADDR_AFTER_AE_L
tHOLD_ADDR_BEFORE_WR_L
tDATA_AFTER_WR_L
tBEN_AFTER_AE_L
tADDR_AFTER_CLKH
tRELEASE_MS_AFTER_WR_H
Figure 12. External Memory Write Cycle (See Table 78)
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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