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参数资料
| 型号： | ADUC7028BBCZ62-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 71/104页 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 62K 12BIT |
| 产品培训模块： | ARM7 Applications & Tools Intro to ARM7 Core & Microconverters |
| 标准包装： | 2,500 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心处理器： | ARM7 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 44MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | PLA，PWM，PSM，温度传感器，WDT |
| 输入/输出数： | 30 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 32 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 数据转换器： | A/D 8x12b，D/A 4x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 64-LFBGA，CSPBGA |
| 包装： | 带卷 (TR) |
| 配用： | EVAL-ADUC7028QSZ-ND - KIT DEV ADUC7028 QUICK START |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页当前第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页
Data Sheet
ADuC7019/20/21/22/24/25/26/27/28/29
Rev. F | Page 69 of 104
Table 83. GPIO Drive Strength Control Bits Descriptions
Control Bits Value
Description
00
Medium drive strength.
01
Low drive strength.
1x
High drive strength.
3.6
3.4
3.2
3.0
2.8
2.6
2.4
2.2
2.0
–24
–18
–12
–6
0
6
12
18
24
LOAD CURRENT (mA)
V
O
L
T
AG
E
O
N
E
ACH
P
IN
(
V
)
HIGH DRIVE STRENGTH
MEDIUM DRIVE STRENGTH
LOW DRIVE STRENGTH
04955-
031
Figure 73. Programmable Strength for High Level
(Typical Values)
0.5
0.4
0.3
0.2
0.1
0
–0.1
–0.2
–0.3
–0.4
–24
–18
–12
–6
0
6
12
18
24
LOAD CURRENT (mA)
V
O
L
T
AG
E
O
N
E
ACH
P
IN
(
V
)
HIGH DRIVE STRENGTH
MEDIUM DRIVE STRENGTH
LOW DRIVE STRENGTH
04955-
032
Figure 74. Programmable Strength for Low Level
(Typical Values)
The drive strength bits can be written to one time only after
reset. More writing to related bits has no effect on changing
drive strength. The GPIO drive strength and pull-up disable is
not always adjustable for the GPIO port. Some control bits
cannot be changed (see Table 84).
Table 84. GPxPAR Control Bits Access Descriptions
Bit
GP0PAR
GP1PAR
31
Reserved
30 to 29
R/W
28
R/W
27
Reserved
26 to 25
R/W
24
R/W
23
Reserved
22 to 21
R/W
R (b00)
20
R/W
19
Reserved
18 to 17
R (b00)
16
R/W
15
Reserved
14 to 13
R (b00)
12
R/W
11
Reserved
10 to 9
R (b00)
8
R/W
7
Reserved
6 to 5
R (b00)
4
R/W
3
Reserved
2 to 1
R (b00)
0
R/W
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