参数资料
| 型号： | ADV7183BBSTZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 86/100页 |
| 文件大小： | 0K |
| 描述： | IC VIDEO DECODER NTSC 80-LQFP |
| 产品培训模块： | Interfacing AV Converters to Blackfin Processors |
| 标准包装： | 1 |
| 类型： | 视频解码器 |
| 应用： | 投影仪，录音机，安全 |
| 电压 - 电源，模拟： | 3.15 V ~ 3.45 V |
| 电压 - 电源，数字： | 1.65 V ~ 2 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 80-LQFP |
| 供应商设备封装： | 80-LQFP（14x14） |
| 包装： | 托盘 |
| 产品目录页面： | 788 (CN2011-ZH PDF) |
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ADV7183B
Rev. B | Page 86 of 100
Bits
Subaddress
Register
Bit Description
7
6
5
4
3
2
1
0
Comments
Notes
NFTOG[4:0]. Number of lines after
lCOUNT rollover to toggle F signal.
0
1
NTSC default.
0
Set to low when manual
programming.
NFTOGSIGN
1
Not suitable for user
programming.
0
No delay.
NFTOGDELE. Delay F transition by
one line relative to NFTOG (even
field).
1
Additional delay by 1
line.
0
No delay.
0xE7
NTSC F Bit
Toggle
NFTOGDELO. Delay F transition by
one line relative to NFTOG (odd
field).
1
Additional delay by 1
line.
PVBEG[4:0]. Number of lines after
lCOUNT rollover to set V high.
0
1
0
1
PAL default (BT.656).
0
Set to low when manual
programming.
PVBEGSIGN
1
Not suitable for user
programming.
0
No delay.
PVBEGDELE. Delay V bit going
high by one line relative to PVBEG
(even field).
1
Additional delay by 1
line.
0
No delay.
0xE8
PAL V Bit
Begin
PVBEGDELO. Delay V bit going
high by one line relative to PVBEG
(odd field).
1
Additional delay by 1
line.
PVEND[4:0]. Number of lines after
lCOUNT rollover to set V low.
1
0
1
0
PAL default (BT.656).
0
Set to low when manual
programming.
PVENDSIGN
1
Not suitable for user
programming.
0
No delay.
PVENDDELE. Delay V bit going low
by one line relative to PVEND
(even field).
1
Additional delay by 1
line.
0
No delay.
0xE9
PAL V Bit
End
PVENDDELO. Delay V bit going
low by one line relative to PVEND
(odd field).
1
Additional delay by 1
line.
PFTOG[4:0]. Number of lines after
lCOUNT rollover to toggle F signal.
0
1
PAL default (BT.656).
0
Set to low when manual
programming.
PFTOGSIGN
1
Not suitable for user
programming.
0
No delay.
PFTOGDELE. Delay F transition by
one line relative to PFTOG (even
field).
1
Additional delay by 1
line.
0
No delay.
0xEA
PAL F Bit
Toggle
PFTOGDELO. Delay F transition by
one line relative to PFTOG (odd
field).
1
Additional delay by 1
line.
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PDF描述 |
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参数描述 |
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