参数资料
型号: AGL030V2-FQNG48
元件分类: FPGA
英文描述: FPGA, 768 CLBS, 30000 GATES, QCC48
封装: GREEN, QFN-48
文件页数: 39/216页
文件大小: 6519K
代理商: AGL030V2-FQNG48
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IGLOO DC and Switching Characteristics
Ad vance v0.5
2- 119
Advance v0.1
(January 2008)
references to tables notes 4, 6, 7, and 8. VMV was added to the VCCI parameter
row, and table note 9 was added.
Temperature1, the maximum operating junction temperature was changed
from 110° to 100°.
table title was modified to remove "as measured on quiet I/Os." Table note 2
was revised to remove "estimated SSO density over cycles." Table note 3 was
revised
to
remove
"refers
only
to
overshoot/undershoot
limits
for
simultaneous switching I/Os.
"
is new.
EQ 2-2 was updated. The temperature was changed to 100°C, and therefore
the end result changed.
V)* were updated to remove VMV and include PDC6 and PDC7. VCCI and VJTAG
were removed from the statement about IDD in the table note for
Mode1 was updated to include VCCPLL. Note 4 was updated to include PDC6
and PDC7.
to change PDC2 to PDC6 and PDC3 to PDC7. The table notes were updated to
reflect that power was measured on VCCI.
through
to add PDC6 and PDC7, and to change the definition for PDC5 to bank quiescent
power. Subtitles were added to indicate type of devices and core supply
voltage.
the calculation of PSTAT, including PDC6 and PDC7.
In
Consumption in IGLOO Devices, the description for PAC13 was changed from
Static to Dynamic.
Footnote 1 was updated to include information about PAC13. The PLL
Contribution equation was changed from: PPLL = PAC13 + PAC14 * FCLKOUT to PPLL
= PDC4 + PAC13 * FCLKOUT.
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PDF描述
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AGL10002-FFG144 FPGA, 1000000 GATES, 200 MHz, PBGA144
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