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参数资料
型号： AGLN020V5-UCG81
厂商： Microsemi SoC
文件页数： 147/150页
文件大小： 0K
描述： IC FPGA 20K 1.5V UCG81
标准包装： 490
系列： IGLOO nano
逻辑元件/单元数： 520
输入/输出数： 52
门数： 20000
电源电压： 1.425 V ~ 1.575 V
安装类型： 表面贴装
工作温度： -20°C ~ 70°C
封装/外壳： 81-WFBGA，CSBGA
供应商设备封装： 81-UCSP（4x4）
其它名称： 1100-1128
IGLOO nano DC and Switching Characteristics
2-80
Revision 17
Table 2-105 RAM512X18
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V
Parameter
Description
Std. Units
tAS
Address setup time
1.28
ns
tAH
Address hold time
0.25
ns
tENS
REN, WEN setup time
1.13
ns
tENH
REN, WEN hold time
0.13
ns
tDS
Input data (WD) setup time
1.10
ns
tDH
Input data (WD) hold time
0.55
ns
tCKQ1
Clock High to new data valid on RD (output retained)
6.56
ns
tCKQ2
Clock High to new data valid on RD (pipelined)
2.67
ns
tC2CRWH1
Address collision clk-to-clk delay for reliable read access after write on same address;
applicable to opening edge
0.87
ns
tC2CWRH1
Address collision clk-to-clk delay for reliable write access after read on same address;
applicable to opening edge
1.04
ns
tRSTBQ
RESET LOW to data out LOW on RD (flow through)
3.21
ns
RESET LOW to data out LOW on RD (pipelined)
3.21
ns
tREMRSTB
RESET removal
0.93
ns
tRECRSTB
RESET recovery
4.94
ns
tMPWRSTB RESET minimum pulse width
1.18
ns
tCYC
Clock cycle time
10.90
ns
FMAX
Maximum frequency
92
MHz
Notes:
1. For more information, refer to the application note Simultaneous Read-Write Operations in Dual-Port SRAM for Flash-
Based cSoCs and FPGAs.
2. For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
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