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参数资料
| 型号： | AGLN020V5-UCG81 |
| 厂商： | Microsemi SoC |
| 文件页数： | 48/150页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 20K 1.5V UCG81 |
| 标准包装： | 490 |
| 系列： | IGLOO nano |
| 逻辑元件/单元数： | 520 |
| 输入/输出数： | 52 |
| 门数： | 20000 |
| 电源电压： | 1.425 V ~ 1.575 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -20°C ~ 70°C |
| 封装/外壳： | 81-WFBGA，CSBGA |
| 供应商设备封装： | 81-UCSP（4x4） |
| 其它名称： | 1100-1128 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页当前第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页
Revision 17
5-1
5 – Datasheet Information
List of Changes
The following table lists critical changes that were made in each version of the IGLOO nano datasheet.
Revision
Changes
Page
Revision 17
(May 2013)
Deleted details related to Ambient temperature from "Enhanced Commercial
Offerings", and Table 2-2 Recommended Operating Conditions 1 to remove ambiguities
arising due to the same, and modified Note 2 (SAR 47063).
and 2-2
Revision 16
(December 2012)
The "IGLOO nano Ordering Information" section has been updated to mention "Y" as
"Blank" mentioning "Device Does Not Include License to Implement IP Based on the
Cryptography Research, Inc. (CRI) Patent Portfolio" (SAR 43174).
The note in Table 2-100 IGLOO nano CCC/PLL Specification and Table 2-101 IGLOO
nano CCC/PLL Specification referring the reader to SmartGen was revised to refer
instead to the online help associated with the core (SAR 42565).
2-70,
Live at Power-Up (LAPU) has been replaced with ’Instant On’.
NA
Revision 15
(September 2012)
The status of the AGLN125 device has been modified from ’Advance’ to ’Production’ in
the "IGLOO nano Device Status" section (SAR 41416).
Libero Integrated Design Environment (IDE) was changed to Libero System-on-Chip
(SoC) throughout the document (SAR 40274).
NA
Revision 14
(September 2012)
The "Security" section was modified to clarify that Microsemi does not support read-back
of programmed data.
Revision 13
(June 2012)
Figure Figure 2-34 FIFO Read and Figure 2-35 FIFO Write have been added (SAR
34842).
The following sentence was removed from the "VMVx I/O Supply Voltage (quiet)" section
in the "Pin Descriptions" section: "Within the package, the VMV plane is decoupled from
the simultaneous switching noise originating from the output buffer VCCI domain" and
replaced with “Within the package, the VMV plane biases the input stage of the I/Os in
the I/O banks” (SAR 38319). The datasheet mentions that "VMV pins must be connected
to the corresponding VCCI pins" for an ESD enhancement.
Revision 12
(March 2012)
revised to clarify that although no existing security measures can give an absolute
guarantee, Microsemi FPGAs implement the best security available in the industry (SAR
34663).
Notes indicating that AGLN015 is not recommended for new designs have been added
(SAR 35759).
Notes indicating that nano-Z devices are not recommended for new designs have been
added. The "Devices Not Recommended For New Designs" section is new (SAR
36759).
The Y security option and Licensed DPA Logo were added to the "IGLOO nano Ordering
Information" section. The trademarked Licensed DPA Logo identifies that a product is
covered by a DPA counter-measures license from Cryptography Research (SAR 34722).
The following sentence was removed from the "Advanced Architecture" section: "In
addition, extensive on-chip programming circuitry enables rapid, single-voltage (3.3 V)
programming of IGLOO nano devices via an IEEE 1532 JTAG interface" (SAR 34683).
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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