参数资料
| 型号： | APA075-FG144 |
| 厂商： | Microsemi SoC |
| 文件页数： | 143/178页 |
| 文件大小： | 0K |
| 描述： | IC FPGA PROASIC+ 75K 144-FBGA |
| 标准包装： | 160 |
| 系列： | ProASICPLUS |
| RAM 位总计： | 27648 |
| 输入/输出数： | 100 |
| 门数： | 75000 |
| 电源电压： | 2.3 V ~ 2.7 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 144-LBGA |
| 供应商设备封装： | 144-FPBGA（13x13） |
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ProASICPLUS Flash Family FPGAs
v5.9
2-57
Asynchronous SRAM Write
Note: The plot shows the normal operation status.
Figure 2-30 Asynchronous SRAM Write
Table 2-54 TJ = 0°C to 110°C; VDD = 2.3 V to 2.7 V for Commercial/Industrial
TJ = –55°C to 150°C, VDD = 2.3 V to 2.7 V for Military/MIL-STD-883B
Symbol txxx
Description
Min.
Max.
Units
Notes
AWRH
WADDR hold from WB
↑
1.0
ns
AWRS
WADDR setup to WB
↓
0.5
ns
DWRH
DI hold from WB
↑
1.5
ns
DWRS
DI setup to WB
↑
0.5
ns
PARGEN is inactive.
DWRS
DI setup to WB
↑
2.5
ns
PARGEN is active.
WPDA
WPE access from DI
3.0
ns
WPE is invalid, while PARGEN is
active.
WPDH
WPE hold from DI
1.0
ns
WRCYC
Cycle time
7.5
ns
WRMH
WB high phase
3.0
ns
Inactive
WRML
WB low phase
3.0
ns
Active
WRB, WBLKB
WADDR
WPE
DI
tAWRS
tWPDA
tAWRH
tDWRS
tWRML
tWRMH
tWRCYC
tWPDH
tDWRH
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PDF描述 |
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