参数资料
| 型号： | APA150-PQG208I |
| 厂商： | Microsemi SoC |
| 文件页数： | 133/178页 |
| 文件大小： | 0K |
| 描述： | IC FPGA PROASIC+ 150K 208-PQFP |
| 标准包装： | 24 |
| 系列： | ProASICPLUS |
| RAM 位总计： | 36864 |
| 输入/输出数： | 158 |
| 门数： | 150000 |
| 电源电压： | 2.3 V ~ 2.7 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 208-BFQFP |
| 供应商设备封装： | 208-PQFP（28x28） |
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ProASICPLUS Flash Family FPGAs
2- 48
v5.9
Global Input Buffer Delays
Table 2-39 Worst-Case Commercial Conditions
VDDP = 3.0 V, VDD = 2.3 V, TJ = 70°C
Macro Type
Description
Max. tINYH
1
Max. tINYL
2
Units
Std.3
GL33
3.3 V, CMOS Input Levels4, No Pull-up Resistor
1.0
1.1
ns
GL33S
3.3 V, CMOS Input Levels4, No Pull-up Resistor, Schmitt Trigger
1.0
1.1
ns
PECL
PPECL Input Levels
1.0
1.1
ns
Notes:
1. tINYH = Input Pad-to-Y High
2. tINYL = Input Pad-to-Y Low
3. Applies to Military ProASICPLUS devices.
4. LVTTL delays are the same as CMOS delays.
5. For LP Macros, VDDP = 2.3 V for delays.
Table 2-40 Worst-Case Commercial Conditions
VDDP = 2.3 V, VDD = 2.3 V, TJ = 70°C
Macro Type
Description
Max. tINYH
1
Max. tINYL
2
Units
Std.3
GL25LP
2.5 V, CMOS Input Levels4, Low Power
1.1
1.0
ns
GL25LPS
2.5 V, CMOS Input Levels4, Low Power, Schmitt Trigger
1.3
1.0
ns
Notes:
1. tINYH = Input Pad-to-Y High
2. tINYL = Input Pad-to-Y Low
3. Applies to Military ProASICPLUS devices.
4. LVTTL delays are the same as CMOS delays.
5. For LP Macros, VDDP =2.3 V for delays.
相关PDF资料 |
PDF描述 |
|---|---|
| APA150-PQ208I | IC FPGA PROASIC+ 150K 208-PQFP |
| AMC30DRTN-S93 | CONN EDGECARD 60POS DIP .100 SLD |
| ACC44DRTN-S93 | CONN EDGECARD 88POS DIP .100 SLD |
| AMC30DRTH-S93 | CONN EDGECARD 60POS DIP .100 SLD |
| ACC44DRTH-S93 | CONN EDGECARD 88POS DIP .100 SLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| APA150-PQGB | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA150-PQGES | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
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