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参数资料
| 型号： | AS5040-ASST |
| 厂商： | ams |
| 文件页数： | 9/34页 |
| 文件大小： | 0K |
| 描述： | IC ENCODER PROG 10-BIT 16-SSOP |
| 应用说明： | AS5000 Series Magnet Selection Guide AS5000 Series Magnets for Extended Vertical Range |
| 标准包装： | 1 |
| 传感范围： | 45mT ~ 75mT |
| 类型： | 线性，旋转编码器 - 可编程 |
| 电源电压： | 3 V ~ 3.6 V，4.5 V ~ 5.5 V |
| 电流 - 电源： | 21mA |
| 电流 - 输出（最大）： | 4mA |
| 输出类型： | 正交，带刻度角（增量） |
| 特点： | 可编程 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 16-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 16-SSOP |
| 包装： | 标准包装 |
| 产品目录页面： | 804 (CN2011-ZH PDF) |
| 配用： | AS5040 PB-ND - BOARD PROGRAM AS5040 |
| 其它名称： | AS5040-ASSTDKR |
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AS5040
Data Sheet
Parameter
Read-out frequency
Symbol
f CLK
Min
>0
Typ
Max
1
Unit
MHz
Note
Clock frequency to read out serial data
Pulse Width Modulation Output
(operating conditions: T amb = -40 to +125°C, VDD5V = 3.0-3.6V (3V operation) VDD5V = 4.5-5.5V (5V operation) unless otherwise
noted)
Parameter
PWM frequency
Minimum pulse width
Maximum pulse width
Symbol
f PWM
PW MIN
PW MAX
Min
0.927
0.878
0.90
922
Typ
0.976
0.976
1
1024
Max
1.024
1.074
1.10
1126
Unit
KHz
μs
μs
Note
Signal period = 1025μs ± 5% at T amb = 25°C
=1025μs ± 10% at T amb = -40 to +125°C
Position 0d; angle 0 degree
Position 1023d; angle 359.65 degree
Incremental Outputs
(operating conditions: T amb = -40 to +125°C, VDD5V = 3.0-3.6V (3V operation) VDD5V = 4.5-5.5V (5V operation) unless otherwise
noted)
Parameter
Incremental outputs valid
after power-up
Directional indication valid
Symbol
t Incremental
outputs valid
t Dir valid
Min
Typ
Max
500
500
Unit
ns
ns
Note
Time between first falling edge of CSn
after power-up and valid incremental
outputs
Time between rising or falling edge of
LSB output and valid directional indication
Programming Conditions
(operating conditions: T amb = -40 to +125°C, VDD5V = 3.0-3.6V (3V operation) VDD5V = 4.5-5.5V (5V operation) unless otherwise
noted)
Parameter
Programming enable time
Symbol
t Prog enable
Min
2
Typ
Max
Unit
μs
Note
Time between rising edge at Prog pin
and rising edge of CSn
Write data start
t Data in
2
μs
Write data valid
Load programming data
Rise time of V PROG before
CLK PROG
t Data in valid
t Load PROG
t PrgR
250
3
0
ns
μs
μs
Write data at the rising edge of
CLK PROG
Hold time of V PROG after
CLK PROG
Write data – programming
CLK PROG
t PrgH
CLK PROG
0
5
250
μs
kHz
CLK pulse width
Hold time of Vprog after
programming
Programming voltage
Programming voltage off level
Programming current
Analog read CLK
Programmed zener voltage
(log.1)
Unprogrammed zener voltage
(log. 0)
t PROG
t PROG finished
V PROG
V ProgOff
I PROG
CLK Aread
V programmed
V unprogrammed
1.8
2
7.3
0
1
2
7.4
2.2
7.5
1
130
100
100
μs
μs
V
V
mA
kHz
mV
V
During programming; 16 clock cycles
Programmed data is available after
next power-on
Must be switched off after zapping
Line must be discharged to this level
During programming
Analog readback mode
V Ref -V PROG during analog readback
mode (see Analog Readback Mode )
www.austriamicrosystems.com
Revision 2.10
8 - 33
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