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参数资料
| 型号： | AS7C3256A-20JCN |
| 厂商： | ALLIANCE SEMICONDUCTOR CORP |
| 元件分类： | DRAM |
| 英文描述： | Dual 4-Input Positive-NAND Gate 14-TSSOP -40 to 85 |
| 中文描述： | 32K X 8 STANDARD SRAM, 20 ns, PDSO28 |
| 封装： | 0.300 INCH, LEAD FREE, PLASTIC, SOJ-28 |
| 文件页数： | 4/9页 |
| 文件大小： | 248K |
| 代理商： | AS7C3256A-20JCN |
AS7C3256A
4/23/04; v.2.0
Alliance Semiconductor
P. 4 of 9
Read cycle (over the operating range)
3,9
Key to switching waveforms
Rising input
Read waveform 1 (address controlled)
3,6,7,9
Read waveform 2 (CE controlled)
3,6,8,9
Parameter
Symbol
t
RC
t
AA
t
ACE
t
OE
t
OH
t
CLZ
t
CHZ
t
OLZ
t
OHZ
t
PU
t
PD
-10
-12
-15
-20
Unit
ns
Notes
Min
10
Max
–
Min
12
Max
–
Min
15
Max
–
Min
20
Max
–
Read cycle time
Address access time
–
10
–
12
–
15
–
20
ns
3
Chip enable (CE) access time
–
10
–
12
–
15
–
20
ns
3
Output enable (OE) access time
Output hold from address change
–
5
–
6
–
7
–
8
ns
3
–
3
–
3
–
3
–
ns
5
CE LOW to output in low Z
3
–
3
–
3
–
3
–
ns
4, 5
CE HIGH to output in high Z
–
3
–
3
–
4
–
5
ns
4, 5
OE LOW to output in low Z
0
–
0
–
0
–
0
–
ns
4, 5
OE HIGH to output in high Z
–
3
–
3
–
4
–
5
ns
4, 5
Power up time
Power down time
0
–
–
0
–
–
0
–
–
15
0
–
–
ns
ns
4, 5
4, 5
10
12
20
Undefined output/don’t care
Falling input
Address
D
out
Data valid
t
OH
t
AA
t
RC
Supply
current
CE
OE
D
out
t
RC1
t
OE
t
OLZ
t
ACE
t
CHZ
t
CLZ
t
PU
t
PD
I
CC
I
SB
50%
50%
t
OHZ
Data valid
相关PDF资料 |
PDF描述 |
|---|---|
| AS7C3256A-20JI | Dual 4-Input Positive-NAND Gate 14-TSSOP -40 to 85 |
| AS7C3256A-20JIN | Dual 4-Input Positive-NAND Gate 14-TSSOP -40 to 85 |
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相关代理商/技术参数 |
参数描述 |
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| AS7C3256A-20JI | 制造商:ALSC 制造商全称:Alliance Semiconductor Corporation 功能描述:3.3V 32K X 8 CMOS SRAM (Common I/O) |
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| AS7C3256A-20TC | 制造商:ALSC 制造商全称:Alliance Semiconductor Corporation 功能描述:3.3V 32K X 8 CMOS SRAM (Common I/O) |
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