参数资料
型号: AT86RF231-ZFR
厂商: Atmel
文件页数: 132/198页
文件大小: 0K
描述: TXRX LOW POWER 2.4GHZ 32VQFN
标准包装: 1
频率: 2.4GHz
数据传输率 - 最大: 2Mbps
调制或协议: 802.15.4 Zigbee,6LoWPAN,RF4CE,SP100,WirelessHART&trade,ISM
应用: 工业监控和控制,无线报警和安全系统
功率 - 输出: -17dBm ~ 3dBm
灵敏度: -101dBm
电源电压: 1.8 V ~ 3.6 V
电流 - 接收: 12.3mA
电流 - 传输: 14mA
数据接口: PCB,表面贴装
天线连接器: PCB,表面贴装
工作温度: -40°C ~ 85°C
封装/外壳: 32-VFQFN 裸露焊盘
包装: 剪切带 (CT)
其它名称: AT86RF231-ZFRCT
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AT86RF231
Note that IEEE 802.15.4-2006 standard MIC algorithm requires CBC mode encryption only, as it
implements a one-way hash function.
11.1.5
Data Transfer - Fast SRAM Access
The ECB and CBC modules including the AES core are clocked with 16 MHz. One AES opera-
tion takes 24 μs to execute, refer to parameter 12.4.15 in Section 12.4 “Digital Interface Timing
Characteristics” on page 157. That means that the processing of the data is usually faster than
the transfer of the data via the SPI interface.
To reduce the overall processing time the AT86RF231 provides a Fast SRAM access for the
address space 0x82 to 0x94.
Figure 11-5. Packet Structure - Fast SRAM Access Mode
AES run #0
AES run #n
AES access #0
AES access #1
AES access #n+1
MOSI
cmd add cfg P0 P1
... P14 P15 start
cmd add cfg P0 P1
... P14 P15 start
cmd add cfg xx
xx
...
xx
xx start
MISO
stat xx
xx
xx
xx
...
xx
xx
xx
stat xx
xx
xx
C0
... C13 C14 C15
stat xx
xx
xx C0
... C13 C14 C15
Address
0x83
...
0x94
0x83
...
0x94
0x83
...
0x94
byte 0 (cmd)
byte 1 (addr.)
byte 2 (cfg)
byte 3
byte 4
byte 18
byte 19 (start)
MOSI
MISO
SRAM write
PHY_STATUS
address 0x83
XX
<AES_CTRL>
XX
P0[7:0]
XX
P1[7:0]
C0[7:0]
...
...
P15[7:0]
C14[7:0]
<AES_CTRL> (1)
C15[7:0]
Address
0x83
0x84
0x85
0x93
0x94
Note:
Byte 19 is the mirrored version of register AES_CTRL on SRAM address 0x94, see register
description AES_CTRL_MIRROR for details.
In contrast to a standard SRAM access, refer to Section 6.2.3 “SRAM Access Mode” on page
22 , the Fast SRAM access allows writing and reading of data simultaneously during one SPI
access for consecutive AES operations (AES run) .
For each byte P0 transferred to pin 22 (MOSI) for example in "AES access #1" , see Figure 11-5
on page 132 (lower part), the previous content of the respective AES register C0 is clocked out
at pin 20 (MISO) with an offset of one byte.
In the example shown in Figure 11-5 on page 132 the initial plaintext P0 - P15 is written to the
SRAM within "AES access #0" . The last command on address 0x94 (AES_CTRL_MIRROR)
starts the AES operation ( "AES run #0" ). In the next "AES access #1" new plaintext data P0 -
P15 is written to the SRAM for the second AES run, in parallel the ciphertext C0 - C15 from the
first AES run is clocked out at pin MISO. To read the ciphertext from the last "AES run #(n)" one
dummy "AES access #(n+1)" is needed.
Note that the SRAM write access always overwrites the previous processing result.
The Fast SRAM access automatically applies to all write operations to SRAM addresses 0x82 to
0x94.
132
8111C–MCU Wireless–09/09
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