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参数资料
| 型号： | AT89C4051-24PU |
| 厂商： | Atmel |
| 文件页数： | 6/19页 |
| 文件大小： | 0K |
| 描述： | IC MCU 4K FLASH 24MHZ 20-DIP |
| 产品培训模块： | MCU Product Line Introduction |
| 标准包装： | 18 |
| 系列： | 89C |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 24MHz |
| 连通性： | UART/USART |
| 外围设备： | 欠压检测/复位，LED，POR |
| 输入/输出数： | 15 |
| 程序存储器容量： | 4KB（4K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 128 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 6 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 20-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
14
1001F–MICRO–6/08
AT89C4051
21. Shift Register Mode Timing Waveforms
22. AC Testing Input/Output Waveforms
Note:
1. AC Inputs during testing are driven at V
CC - 0.5V for a logic 1 and 0.45V for a logic 0. Timing measurements are made at VIH
min. for a logic 1 and VIL max. for a logic 0.
23. Float Waveforms(1)
Note:
1. For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to
float when 100 mV change from the loaded VOH/VOL level occurs.
20. Serial Port Timing: Shift Register Mode Test Conditions
V
CC = 5.0V ± 20%; Load Capacitance = 80 pF
Symbol
Parameter
12 MHz Osc
Variable Oscillator
Units
Min
Max
Min
Max
tXLXL
Serial Port Clock Cycle Time
1.0
12tCLCL
s
t
QVXH
Output Data Setup to Clock Rising Edge
700
10t
CLCL-133
ns
tXHQX
Output Data Hold after Clock Rising Edge
50
2tCLCL-117
ns
tXHDX
Input Data Hold after Clock Rising Edge
0
ns
t
XHDV
Clock Rising Edge to Input Data Valid
700
10t
CLCL-133
ns
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PDF描述 |
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参数描述 |
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