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参数资料
| 型号： | AT90CAN64-15AT1 |
| 厂商： | Atmel |
| 文件页数： | 50/185页 |
| 文件大小： | 0K |
| 描述： | MCU AVR 64K FLASH 15MHZ 64TQFP |
| 产品培训模块： | MCU Product Line Introduction |
| 标准包装： | 1,000 |
| 系列： | AVR® 90CAN |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 16MHz |
| 连通性： | CAN，I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 53 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 2K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 带卷 (TR) |
| 配用： | ATSTK600-ND - DEV KIT FOR AVR/AVR32 ATDVK90CAN1-ND - KIT DEV FOR AT90CAN128 MCU |
| 其它名称： | AT90CAN64-15AT1-ND AT90CAN64-15AT1TR |
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143
7682C–AUTO–04/08
AT90CAN32/64/128
Bit 2 – OCIEnB: Output Compare B Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Output Compare B Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 60.) is executed when the OCFnB flag, located in
TIFRn, is set.
Bit 1 – OCIEnA: Output Compare A Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Output Compare A Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 60.) is executed when the OCFnA flag, located in
TIFRn, is set.
Bit 0 – TOIEn: Timer/Counter Overflow Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Overflow interrupt is enabled. The corresponding Interrupt Vector
(See “Interrupts” on page 60.) is executed when the TOVn flag, located in TIFRn, is set.
13.11.19 Timer/Counter1 Interrupt Flag Register – TIFR1
13.11.20 Timer/Counter3 Interrupt Flag Register – TIFR3
Bit 7..6 – Reserved Bits
These bits are reserved for future use.
Bit 5 – ICFn: Input Capture Flag
This flag is set when a capture event occurs on the ICPn pin. When the Input Capture Register
(ICRn) is set by the WGMn3:0 to be used as the TOP value, the ICFn flag is set when the
counter reaches the TOP value.
ICFn is automatically cleared when the Input Capture Interrupt Vector is executed. Alternatively,
ICFn can be cleared by writing a logic one to its bit location.
Bit 4 – Reserved Bit
This bit is reserved for future use.
Bit 3 – OCFnC: Output Compare C Match Flag
This flag is set in the timer clock cycle after the counter (TCNTn) value matches the Output
Compare Register C (OCRnC).
Note that a Forced Output Compare (FOCnC) strobe will not set the OCFnC flag.
OCFnC is automatically cleared when the Output Compare Match C Interrupt Vector is exe-
cuted. Alternatively, OCFnC can be cleared by writing a logic one to its bit location.
Bit
7
6
5
4
3
2
1
0
–
ICF1
–
OCF1C
OCF1B
OCF1A
TOV1
TIFR1
Read/Write
R
R/W
R
R/W
Initial Value
0
Bit
7
6
5
4
3
2
1
0
–
ICF3
–
OCF3C
OCF3B
OCF3A
TOV3
TIFR3
Read/Write
R
R/W
R
R/W
Initial Value
0
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PDF描述 |
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参数描述 |
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| AT90CAN64-15MZ | 功能描述:8位微控制器 -MCU 64KB Flash 15MHz RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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