参数资料
| 型号： | AT91SAM9261-CJ |
| 厂商： | Atmel |
| 文件页数： | 17/44页 |
| 文件大小： | 0K |
| 描述： | IC ARM9 MPU 217BGA |
| 标准包装： | 126 |
| 系列： | AT91SAM |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 190MHz |
| 连通性： | EBI/EMI，I²C，MMC，SPI，SSC，UART/USART，USB |
| 外围设备： | DMA，LCD，POR，PWM，WDT |
| 输入/输出数： | 96 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | ROM |
| RAM 容量： | 192K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.08 V ~ 1.32 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 217-LFBGA |
| 包装： | 托盘 |
| 配用： | AT91SAM9261-EK-ND - KIT EVAL FOR AT91SAM926EJ-S AT91SAM-ICE-ND - EMULATOR FOR AT91 ARM7/ARM9 |
| 其它名称： | AT91SAM9261B-CJ AT91SAM9261B-CJ-ND |
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24
6062LS–ATARM–23-Mar-09
AT91SAM9261
9.2
Reset Controller
Based on two Power-on-Reset cells
Status of the last reset
– Either cold reset, first reset, soft reset, user reset, watchdog reset, wake-up reset
Controls the internal resets and the NRST pin output
9.3
Shutdown Controller
Shutdown and Wake-up logic:
– Software programmable assertion of the SHDN pin
– Deassertion Programmable on a WKUP pin level change or on alarm
9.4
General-purpose Backup Registers
Four 32-bit general-purpose backup registers
9.5
Clock Generator
Embeds the Low-power 32768 Hz Slow Clock Oscillator
– Provides the permanent Slow Clock to the system
Embeds the Main Oscillator
– Oscillator bypass feature
– Supports 3 to 20 MHz crystals
Embeds Two PLLs
– Outputs 80 to 240 MHz clocks
– Integrates an input divider to increase output accuracy
– 1 MHz minimum input frequency
Provides SLCK, MAINCK, PLLACK and PLLBCK.
Figure 9-2.
Clock Generator Block Diagram
Power
Management
Controller
XIN
XOUT
PLLRCA
Slow Clock
SLCK
Main Clock
MAINCK
PLLA Clock
PLLACK
Control
Status
PLL and
Divider B
PLLRCB
PLLB Clock
PLLBCK
XIN32
XOUT32
Slow Clock
Oscillator
Main
Oscillator
PLL and
Divider A
Clock Generator
相关PDF资料 |
PDF描述 |
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参数描述 |
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