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参数资料
| 型号： | ATAVRTS2080A |
| 厂商： | Atmel |
| 文件页数： | 341/377页 |
| 文件大小： | 0K |
| 描述： | KIT QTOUCH W/SW ATMEGA88 |
| 产品培训模块： | Touch Interface Solutions Qtouch- Create your own Touch Application megaAVR Introduction |
| 标准包装： | 1 |
| 系列： | QTouch™ |
| 传感器类型： | 触摸，电容式 |
| 传感范围： | 1 个转子，1 个滑块，以及 2 个按钮/键 |
| 接口： | 应用程序编程接口（API） |
| 电源电压： | 1.8 V ~ 5.5 V |
| 嵌入式： | 是，MCU，8 位 |
| 已供物品： | 模块 |
| 已用 IC / 零件： | ATmega88 |
| 产品目录页面： | 2822 (CN2011-ZH PDF) |
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2545T–AVR–05/11
ATmega48/88/168
13. External interrupts
The external interrupts are triggered by the INT0 and INT1 pins or any of the PCINT23..0 pins.
Observe that, if enabled, the interrupts will trigger even if the INT0 and INT1 or PCINT23..0 pins
are configured as outputs. This feature provides a way of generating a software interrupt. The
pin change interrupt PCI2 will trigger if any enabled PCINT23..16 pin toggles. The pin change
interrupt PCI1 will trigger if any enabled PCINT14..8 pin toggles. The pin change interrupt PCI0
will trigger if any enabled PCINT7..0 pin toggles. The PCMSK2, PCMSK1 and PCMSK0 regis-
ters control which pins contribute to the pin change interrupts. Pin change interrupts on
PCINT23..0 are detected asynchronously. This implies that these interrupts can be used for
waking the part also from sleep modes other than idle mode.
The INT0 and INT1 interrupts can be triggered by a falling or rising edge or a low level. This is
set up as indicated in the specification for the external interrupt control register A – EICRA.
When the INT0 or INT1 interrupts are enabled and are configured as level triggered, the inter-
rupts will trigger as long as the pin is held low. Note that recognition of falling or rising edge
interrupts on INT0 or INT1 requires the presence of an I/O clock, described in “Clock systems
and their distribution” on page 27. Low level interrupt on INT0 and INT1 is detected asynchro-
nously. This implies that this interrupt can be used for waking the part also from sleep modes
other than Idle mode. The I/O clock is halted in all sleep modes except Idle mode.
Note that if a level triggered interrupt is used for wake-up from power-down, the required level
must be held long enough for the MCU to complete the wake-up to trigger the level interrupt. If
the level disappears before the end of the start-up time, the MCU will still wake up, but no inter-
rupt will be generated. The start-up time is defined by the SUT and CKSEL Fuses as described
13.1
Pin change interrupt timing
An example of timing of a pin change interrupt is shown in Figure 13-1.
Figure 13-1. Timing of pin change interrupts.
clk
PCINT(0)
pin_lat
pin_sync
pcint_in_(0)
pcint_syn
pcint_setflag
PCIF
PCINT(0)
pin_sync
pcint_syn
pin_lat
D
Q
LE
pcint_setflag
PCIF
clk
PCINT(0) in PCMSK(x)
pcint_in_(0)
0
x
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