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参数资料
| 型号： | C8051F310DK |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 55/228页 |
| 文件大小： | 0K |
| 描述： | DEV KIT FOR C8051F310/F311 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | Silicon Laboratories C8051、F310、311 MCU |
| 所含物品： | 评估板，电源，USB 线缆，适配器和文档 |
| 产品目录页面： | 626 (CN2011-ZH PDF) |
| 相关产品： | C8051F311-GMR-ND - IC 8051 MCU 16K FLASH 28MLP C8051F310-GQR-ND - IC 8051 MCU 16K FLASH 32LQFP 336-1254-ND - IC 8051 MCU 16K FLASH 28MLP 336-1252-ND - IC 8051 MCU 16K FLASH 32LQFP |
| 其它名称： | 336-1253 |
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C8051F310/1/2/3/4/5/6/7
148
Rev. 1.7
14.3.2. Clock Low Extension
SMBus provides a clock synchronization mechanism, similar to I2C, which allows devices with different
speed capabilities to coexist on the bus. A clock-low extension is used during a transfer in order to allow
slower slave devices to communicate with faster masters. The slave may temporarily hold the SCL line
LOW to extend the clock low period, effectively decreasing the serial clock frequency.
14.3.3. SCL Low Timeout
If the SCL line is held low by a slave device on the bus, no further communication is possible. Furthermore,
the master cannot force the SCL line high to correct the error condition. To solve this problem, the SMBus
protocol specifies that devices participating in a transfer must detect any clock cycle held low longer than
25 ms as a “timeout” condition. Devices that have detected the timeout condition must reset the communi-
cation no later than 10 ms after detecting the timeout condition.
When the SMBTOE bit in SMB0CF is set, Timer 3 is used to detect SCL low timeouts. Timer 3 is forced to
reload when SCL is high, and allowed to count when SCL is low. With Timer 3 enabled and configured to
overflow after 25 ms (and SMBTOE set), the Timer 3 interrupt service routine can be used to reset (disable
and re-enable) the SMBus in the event of an SCL low timeout.
14.3.4. SCL High (SMBus Free) Timeout
The SMBus specification stipulates that if the SCL and SDA lines remain high for more that 50 s, the bus
is designated as free. When the SMBFTE bit in SMB0CF is set, the bus will be considered free if SCL and
SDA remain high for more than 10 SMBus clock source periods. If the SMBus is waiting to generate a
Master START, the START will be generated following this timeout. Note that a clock source is required for
free timeout detection, even in a slave-only implementation.
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