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参数资料
| 型号： | C8051F920-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 70/330页 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 32K FLASH 32-QFN |
| 产品培训模块： | C8051F9xx Lower Power MCUs Serial Communication Overview |
| 视频文件： | Designing for Low Power Operation |
| 特色产品： | C8051F91x/0x MCU Series Development Kit |
| 标准包装： | 73 |
| 系列： | C8051F9xx |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 25MHz |
| 连通性： | SMBus（2 线/I²C），SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，温度传感器，WDT |
| 输入/输出数： | 24 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4.25K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 0.9 V ~ 3.6 V |
| 数据转换器： | A/D 23x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 包装： | 托盘 |
| 产品目录页面： | 625 (CN2011-ZH PDF) |
| 配用： | 336-1473-ND - KIT DEV C8051F920,F921,F930,F931 |
| 其它名称： | 336-1470 |
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Rev. 1.4
161
C8051F93x-C8051F92x
14.2. Idle Mode
Setting the Idle Mode Select bit (PCON.0) causes the CIP-51 to halt the CPU and enter Idle mode as soon
as the instruction that sets the bit completes execution. All internal registers and memory maintain their
original data. All analog and digital peripherals can remain active during Idle mode.
Note: To ensure the MCU enters a low power state upon entry into Idle Mode, the one-shot circuit should be
enabled by clearing the BYPASS bit (FLSCL.6) to logic 0. See the note in SFR Definition 13.3. FLSCL:
Flash Scale for more information on how to properly clear the BYPASS bit.
Idle mode is terminated when an enabled interrupt is asserted or a reset occurs. The assertion of an
enabled interrupt will cause the Idle Mode Selection bit (PCON.0) to be cleared and the CPU to resume
operation. The pending interrupt will be serviced and the next instruction to be executed after the return
from interrupt (RETI) will be the instruction immediately following the one that set the Idle Mode Select bit.
If Idle mode is terminated by an internal or external reset, the CIP-51 performs a normal reset sequence
and begins program execution at address 0x0000.
If enabled, the Watchdog Timer (WDT) will eventually cause an internal watchdog reset and thereby termi-
nate the Idle mode. This feature protects the system from an unintended permanent shutdown in the event
of an inadvertent write to the PCON register. If this behavior is not desired, the WDT may be disabled by
software prior to entering the idle mode if the WDT was initially configured to allow this operation. This pro-
vides the opportunity for additional power savings, allowing the system to remain in the Idle mode indefi-
nitely, waiting for an external stimulus to wake up the system. Refer to Section “18.6. PCA Watchdog Timer
Reset” on page 188 for more information on the use and configuration of the WDT.
14.3. Stop Mode
Setting the Stop Mode Select bit (PCON.1) causes the CIP-51 to enter Stop mode as soon as the instruc-
tion that sets the bit completes execution. In Stop mode the precision internal oscillator and CPU are
stopped; the state of the low power oscillator and the external oscillator circuit is not affected. Each analog
peripheral (including the external oscillator circuit) may be shut down individually prior to entering Stop
Mode. Stop mode can only be terminated by an internal or external reset. On reset, the CIP-51 performs
the normal reset sequence and begins program execution at address 0x0000.
If enabled, the Missing Clock Detector will cause an internal reset and thereby terminate the Stop mode.
The Missing Clock Detector should be disabled if the CPU is to be put to in STOP mode for longer than the
MCD timeout of 100 s.
Stop Mode is a legacy 8051 power mode; it will not result in optimal power savings. Sleep or Suspend
mode will provide more power savings if the MCU needs to be inactive for a long period of time.
On C8051F930, C8051F931, C8051F920, and C8051F921 devices, the Precision Oscillator Bias is not
automatically disabled and should be disabled by software to achieve the lowest possible Stop mode cur-
rent.
Note: To ensure the MCU enters a low power state upon entry into Stop Mode, the one-shot circuit should be
enabled by clearing the BYPASS bit (FLSCL.6) to logic 0. See the note in SFR Definition 13.3. FLSCL:
Flash Scale for more information on how to properly clear the BYPASS bit.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| C8051F920-GMR | 功能描述:8位微控制器 -MCU 32KB 10ADC MCU LEAD FREE RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F920-GQ | 功能描述:8位微控制器 -MCU 32KB 10ADC MCU LEAD FREE RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F920-GQR | 功能描述:8位微控制器 -MCU 32KB 10ADC MCU LEAD FREE RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F921 | 制造商:SILABS 制造商全称:SILABS 功能描述:25 MIPS, 8 kB Flash, Ultra Low Power, Capacitive Sensing MCU |
| C8051F921-F-GM | 制造商:Silicon Laboratories Inc 功能描述:32KB,10ADC,24PIN MCU - Rail/Tube 制造商:Silicon Laboratories Inc 功能描述:MCU 32KB FLASH 10BIT ADC 24QFN |
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