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参数资料
| 型号： | CAN-OBD-RD |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 171/312页 |
| 文件大小： | 0K |
| 描述： | KIT REF DESIGN CAN DIAGNOSTIC |
| 标准包装： | 1 |
| 主要目的： | 接口，CAN OBD 读取器 |
| 嵌入式： | 是，MCU，8 位 |
| 已用 IC / 零件： | C8051F502 |
| 主要属性： | CAN 板载诊断（OBD-II）参考设计 |
| 次要属性： | 支持模式 1、2 和 3，500kbps |
| 已供物品： | 板，ToolStick 适配器，线缆，CD，文档 |
| 产品目录页面： | 626 (CN2011-ZH PDF) |
| 相关产品： | 336-1515-5-ND - IC 8051 MCU 64K FLASH 32-QFN 336-1514-ND - IC 8051 MCU 64K FLASH 32-QFP |
| 其它名称： | 336-1559 |
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C8051F50x/F51x
252
Rev. 1.2
25. Enhanced Serial Peripheral Interface (SPI0)
The Enhanced Serial Peripheral Interface (SPI0) provides access to a flexible, full-duplex synchronous
serial bus. SPI0 can operate as a master or slave device in both 3-wire or 4-wire modes, and supports mul-
tiple masters and slaves on a single SPI bus. The slave-select (NSS) signal can be configured as an input
to select SPI0 in slave mode, or to disable Master Mode operation in a multi-master environment, avoiding
contention on the SPI bus when more than one master attempts simultaneous data transfers. NSS can
also be configured as a chip-select output in master mode, or disabled for 3-wire operation. Additional gen-
eral purpose port I/O pins can be used to select multiple slave devices in master mode.
Figure 25.1. SPI Block Diagram
SFR Bus
Data Path
Control
SFR Bus
Write
SPI0DAT
Receive Data Buffer
SPI0DAT
0
1
2
3
4
5
6
7
Shift Register
SPI CONTROL LOGIC
SPI0CKR
SC
R7
SC
R6
SC
R5
SC
R4
SC
R3
SC
R2
SC
R1
SC
R0
SPI0CFG
SPI0CN
Pin Interface
Control
Pin
Control
Logic
C
R
O
S
B
A
R
Port I/O
Read
SPI0DAT
SPI IRQ
Tx Data
Rx Data
SCK
MOSI
MISO
NSS
Transmit Data Buffer
Clock Divide
Logic
SYSCLK
CKP
H
A
CK
P
O
L
SL
VSE
L
NS
S
M
D1
NS
S
M
D0
SPIBS
Y
MSTEN
NS
S
IN
SRMT
RX
B
M
T
SPIF
WCO
L
MOD
F
RX
O
V
R
N
TXB
M
T
SPIEN
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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