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参数资料
| 型号： | CAT9532YI-T2 |
| 厂商： | ON Semiconductor |
| 文件页数： | 5/15页 |
| 文件大小： | 0K |
| 描述： | IC LED DRIVER LINEAR 24-TSSOP |
| 标准包装： | 1 |
| 拓扑： | 开路漏极，PWM |
| 输出数： | 16 |
| 内部驱动器： | 是 |
| 类型 - 主要： | 背光，LED 闪烁器 |
| 类型 - 次要： | RGB |
| 频率： | 400kHz |
| 电源电压： | 2.3 V ~ 5.5 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP |
| 包装： | 标准包装 |
| 工作温度： | -40°C ~ 85°C |
| 产品目录页面： | 805 (CN2011-ZH PDF) |
| 其它名称： | CAT9532YI-T2DKR |
CAT9532
Table 4. A.C. CHARACTERISTICS (V CC = 2.3 V to 5.5 V, T A = ? 40 ° C to +85 ° C, unless otherwise specified) (Note 5)
Standard I 2 C
Fast I 2 C
Symbol
Parameter
Min
Max
Min
Max
Units
F SCL
t HD:STA
t LOW
t HIGH
t SU:STA
t HD:DAT
t SU:DAT
t R (Note 6)
t F (Note 6)
t SU:STO
t BUF (Note 6)
t AA
t DH
T i (Note 6)
Clock Frequency
START Condition Hold Time
Low Period of SCL Clock
High Period of SCL Clock
START Condition Setup Time
Data In Hold Time
Data In Setup Time
SDA and SCL Rise Time
SDA and SCL Fall Time
STOP Condition Setup Time
Bus Free Time Between STOP and START
SCL Low to Data Out Valid
Data Out Hold Time
Noise Pulse Filtered at SCL and SDA Inputs
4
4.7
4
4.7
0
250
4
4.7
100
100
1000
300
3.5
100
0.6
1.3
0.6
0.6
0
100
0.6
1.3
50
400
300
300
0.9
100
kHz
m s
m s
m s
m s
m s
ns
ns
ns
m s
m s
m s
ns
ns
PORT TIMING
t PV
t PS
t PH
Output Data Valid
Input Data Setup Time
Input Data Hold Time
100
1
200
ns
ns
m s
RESET
t W (Note 6)
t REC
t RESET (Note 7)
Reset Pulse Width
Reset Recovery Time
Time to Reset
10
0
400
ns
ns
ns
5. Test conditions according to “AC Test Conditions” table.
6. This parameter is characterized initially and after a design or process change that affects the parameter. Not 100% tested.
7. The full delay to reset the part will be the sum of t RESET and the RC time constant of the SDA line.
Table 5. AC TEST CONDITIONS
Input Pulse Voltage
Input Rise and Fall Times
Input Reference Voltage
Output Reference Voltage
Output Load
0.2 V CC to 0.8 V CC
≤ 5 ns
0.3 V CC , 0.7 V CC
0.5 V CC
Current source: I OL = 3 mA; 400 pF for f SCL(max) = 400 kHz
SCL
t F
t LOW
t HIGH
t LOW
t R
t SU:STA
t HD:STA
t HD:DAT
t SU:DAT
t SU:STO
SDA IN
t AA
t DH
t BUF
SDA OUT
Figure 4. 2 ? Wire Serial Interface Timing
http://onsemi.com
5
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