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参数资料
| 型号： | CDB42L51 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 13/43页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS42L51 CODEC |
| 标准包装： | 1 |
| 主要目的： | 音频编解码器 |
| 嵌入式： | 是，其它 |
| 已用 IC / 零件： | CS42L51，CS8406，CS8415 |
| 主要属性： | 立体声数字音频发射器和接收器 |
| 次要属性： | 图形用户界面，S/PDIF 接口 |
| 已供物品： | 板，CD |
| 相关产品： | CS42L51-DNZR-ND - IC CODEC STEREO W/HDPN AMP 32QFN 598-1627-ND - IC CODEC STEREO W/HDPN AMP 32QFN CS42L51-CNZR-ND - IC CODEC LOW-V 24BIT 32-QFP 598-1045-ND - IC CODEC STEREO W/HDPN AMP 32QFN |
| 其它名称： | 598-1005 |
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20
DS679F1
CS42L51
COMBINED DAC INTERPOLATION & ON-CHIP ANALOG FILTER RESPONSE
Notes:
12. Response is clock dependent and will scale with Fs. Note that the response plots (Figure 38 to Figure 41
on page 82) have been normalized to Fs and can be de-normalized by multiplying the X-axis scale by Fs.
13. Measurement Bandwidth is from Stopband to 3 Fs.
SWITCHING SPECIFICATIONS - SERIAL PORT
(Inputs: Logic 0 = DGND, Logic 1 = VL, SDOUT CLOAD = 15 pF.)
Parameter (Note 12)
Min
Typ
Max
Unit
Frequency Response 10 Hz to 20 kHz
-0.01
-
+0.08
dB
Passband
to -0.05 dB corner
to -3 dB corner
0
-
0.4780
0.4996
Fs
StopBand
0.5465
-
Fs
StopBand Attenuation (Note 13)
50
-
dB
Group Delay
-
10.4/Fs
-
s
De-emphasis Error
Fs = 32 kHz
Fs = 44.1 kHz
Fs = 48 kHz
-
+1.5/+0
+0.05/-0.25
-0.2/-0.4
dB
Parameters
Symbol
Min
Max
Units
RESET pin Low Pulse Width
1-
ms
MCLK Frequency
1.024
38.4
MHz
MCLK Duty Cycle
45
55
%
Slave Mode
Input Sample Rate (LRCK)
Quarter-Speed Mode
Half-Speed Mode
Single-Speed Mode
Double-Speed Mode
Fs
4
8
4
50
12.5
25
50
100
kHz
LRCK Duty Cycle
45
55
%
SCLK Frequency
1/tP
-64Fs
Hz
SCLK Duty Cycle
45
55
%
LRCK Setup Time Before SCLK Rising Edge
ts(LK-SK)
40
-
ns
LRCK Edge to SDOUT MSB Output Delay
td(MSB)
-52
ns
SDOUT Setup Time Before SCLK Rising Edge
ts(SDO-SK)
20
-
ns
SDOUT Hold Time After SCLK Rising Edge
th(SK-SDO)
30
-
ns
SDIN Setup Time Before SCLK Rising Edge
ts(SD-SK)
20
-
ns
SDIN Hold Time After SCLK Rising Edge
th
20
-
ns
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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