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参数资料
| 型号： | CDB42L51 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 16/43页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS42L51 CODEC |
| 标准包装： | 1 |
| 主要目的： | 音频编解码器 |
| 嵌入式： | 是，其它 |
| 已用 IC / 零件： | CS42L51，CS8406，CS8415 |
| 主要属性： | 立体声数字音频发射器和接收器 |
| 次要属性： | 图形用户界面，S/PDIF 接口 |
| 已供物品： | 板，CD |
| 相关产品： | CS42L51-DNZR-ND - IC CODEC STEREO W/HDPN AMP 32QFN 598-1627-ND - IC CODEC STEREO W/HDPN AMP 32QFN CS42L51-CNZR-ND - IC CODEC LOW-V 24BIT 32-QFP 598-1045-ND - IC CODEC STEREO W/HDPN AMP 32QFN |
| 其它名称： | 598-1005 |
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DS679F1
23
CS42L51
SWITCHING CHARACTERISTICS - SPI CONTROL PORT
(Inputs: Logic 0 = DGND, Logic 1 = VL)
20. Data must be held for sufficient time to bridge the transition time of CCLK.
21. For fsck <1 MHz.
Parameter
Symbol
Min
Max
Units
CCLK Clock Frequency
fsck
06.0
MHz
RESET Rising Edge to CS Falling
tsrs
20
-
ns
CS Falling to CCLK Edge
tcss
20
-
ns
CS High Time Between Transmissions
tcsh
1.0
-
s
CCLK Low Time
tscl
66
-
ns
CCLK High Time
tsch
66
-
ns
CDIN to CCLK Rising Setup Time
tdsu
40
-
ns
CCLK Rising to DATA Hold Time
tdh
15
-
ns
Rise Time of CCLK and CDIN
tr2
-100
ns
Fall Time of CCLK and CDIN
tf2
-100
ns
CS
CCLK
CDIN
RST
t
srs
t
scl
t
sch
t
css
t
r2
t
f2
t
csh
t
dsu
t
dh
Figure 7. Control Port Timing - SPI Format
相关PDF资料 |
PDF描述 |
|---|---|
| GMM11DRKI | CONN EDGECARD 22POS DIP .156 SLD |
| UPJ1J151MHD6TO | CAP ALUM 150UF 63V 20% RADIAL |
| ECA22DTKI | CONN EDGECARD 44POS DIP .125 SLD |
| M1TXK-3436J | IDC CABLE - MSD34K/MC34G/X |
| GEM28DREI | CONN EDGECARD 56POS .156 EYELET |
相关代理商/技术参数 |
参数描述 |
|---|---|
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