参数资料
| 型号： | CS4384-CQZR |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 9/52页 |
| 文件大小： | 0K |
| 描述： | IC DAC 8CH 103DB 192KHZ 48-LQFP |
| 标准包装： | 2,000 |
| 位数： | 24 |
| 数据接口： | 串行 |
| 转换器数目： | 8 |
| 电压电源： | 模拟和数字 |
| 功率耗散（最大）： | 520mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 8 电压，单极 |
| 采样率（每秒）： | 216k |
| 配用： | 598-1525-ND - BOARD EVAL FOR CS4384 DAC |
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DS620F1
17
CS4384
SWITCHING CHARACTERISTICS - CONTROL PORT - SPI FORMAT
(Inputs: Logic 0 = GND, Logic 1 = VLC, CL =30pF)
Notes:
18. tspi only needed before first falling edge of CS after RST rising edge. tspi = 0 at all other times.
19. Data must be held for sufficient time to bridge the transition time of CCLK.
20. For FSCK < 1 MHz.
Parameter
Symbol
Min
Max
Unit
CCLK Clock Frequency
fsclk
-6
MHz
RST Rising Edge to CS Falling
tsrs
500
-
ns
CCLK Edge to CS Falling
tspi
500
-
ns
CS High Time Between Transmissions
tcsh
1.0
-
s
CS Falling to CCLK Edge
tcss
20
-
ns
CCLK Low Time
tscl
66
-
ns
CCLK High Time
tsch
66
-
ns
CDIN to CCLK Rising Setup Time
tdsu
40
-
ns
CCLK Rising to DATA Hold Time
tdh
15
-
ns
Rise Time of CCLK and CDIN
tr2
-100
ns
Fall Time of CCLK and CDIN
tf2
-100
ns
t r2
t f2
t dsu t dh
t sch
t scl
CS
CC L K
CD IN
t css
t csh
t spi
t srs
RST
Figure 6. Control Port Timing - SPI Format
相关PDF资料 |
PDF描述 |
|---|---|
| CS4385-DQZR | IC DAC 8CH 114DB 192KHZ 48-LQFP |
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| CS4392-KZZ | IC DAC 24BIT 192KHZ W/VC 20TSSOP |
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| CS4398-CZZ | IC DAC 120DB 192KHZ W/VC 28TSSOP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| CS4384-DQZ | 制造商:CIRRUS 制造商全称:Cirrus Logic 功能描述:103 dB, 192 kHz 8-Channel D/A Converter |
| CS4384-DQZR | 制造商:CIRRUS 制造商全称:Cirrus Logic 功能描述:103 dB, 192 kHz 8-Channel D/A Converter |
| CS4385 | 制造商:CIRRUS 制造商全称:Cirrus Logic 功能描述:114 dB, 192kHz 8-CHANNEL D/A CONVERTER |
| CS4385_07 | 制造商:CIRRUS 制造商全称:Cirrus Logic 功能描述:114 dB, 192 kHz 8-Channel D/A Converter |
| CS4385_08 | 制造商:CIRRUS 制造商全称:Cirrus Logic 功能描述:114 dB, 192 kHz 8-Channel D/A Converter |
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