参数资料
| 型号： | CS5526-BSZR |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 4/30页 |
| 文件大小： | 0K |
| 描述： | IC ADC 20BIT W/4BIT LATCH 20SSOP |
| 标准包装： | 1,000 |
| 位数： | 20 |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 12.7mW |
| 电压电源： | 双 ± |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 20-SSOP |
| 包装： | 带卷 (TR) |
| 输入数目和类型： | 1 个差分，单极；1 个差分，双极 |
| 配用： | 598-1014-ND - EVAL BOARD FOR CS5526 |
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CS5525 CS5526
12
DS202F5
Configuration Register
* R indicates the bit value after the part is reset
D23(MSB)
D22
D21
D20
D19
D18
D17
D16
D15
D14
D13
D12
A3
A2
A1
A0
NU
CFS
NU
LPM
WR2
WR1
WR0
U/B
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
G2
G1
G0
PD
RS
RV
PF
PSS
DF
CC2
CC1
CC0
BIT
NAME
VALUE
FUNCTION
D23-D20
Latch Outputs, A3-A0
0000
R* Latch Output Pins A3-A0 mimic the D23-D20 Register bits.
D19
Not Used, NU
0
R Must always be logic 0.
D18
Chop Frequency Select,
CFS
0
1
R 256 Hz Amplifier chop frequency
32768 Hz Amplifier chop frequency
D17
Not Used, NU
0
R Must always be logic 0.
D16
Low Power Mode, LPM
0
1
R Normal Mode
Reduced Power mode
D15-D13
Word Rate, WR2-0
Note: For
XIN = 32.768kHz
000
001
010
011
100
101
110
111
R 15.0 Sps (2182 XIN cycles)
30.1 Sps (1090 XIN cycles)
60.0 Sps (546 XIN cycles)
123.2 Sps (266 XIN cycles)
168.9 Sps (194 XIN cycles)
202.3 Sps (162 XIN cycles)
3.76 Sps (8722 XIN cycles)
7.51 Sps (4362 XIN cycles)
D12
Unipolar/Bipolar, U/B
0
1
R Bipolar Measurement mode
Unipolar Measurement mode
D11-D9
Gain Bits, G2-G0
000
001
010
011
100
101
110/111
R 100 mV (assumes VREF = 2.5V)
55 mV
25 mV
1V
5.0 V
2.5 V
Not Used.
D8
Pump Disable, PD
0
1
R Charge Pump Enabled
For PD = 1, the CPD pin goes to a Hi-Z output state.
D7
Reset System, RS
0
1
R Normal Operation
Activate a Reset cycle. To return to Normal Operation write bit to zero.
D6
Reset Valid , RV
0
1R
No reset has occurred or bit has been cleared (read only).
Valid Reset has occurred. (Cleared when read.)
D5
Port Flag, PF
0
1
R Port Flag mode inactive
Port Flag mode active
D4
Power Save Select, PSS
0
1
R Standby Mode (Oscillator active, allows quick power-up)
Sleep Mode (Oscillator inactive)
D3
Done Flag, DF
0
1
R Done Flag bit is cleared (read only).
Calibration or Conversion cycle completed (read only).
D2-D0
Calibration Control Bits,
CC2-CC0
000
001
010
011
100
101
110
111
R Normal Operation (no calibration)
Offset -- Self-Calibration
Gain -- Self-Calibration
Offset Self-Calibration followed by Gain Self-Calibration
Not used.
Offset -- System Calibration
Gain -- System Calibration
Not Used.
Table 2. Configuration Register
相关PDF资料 |
PDF描述 |
|---|---|
| CS5528-ASZR | IC ADC 24BIT 8CH 24-SSOP |
| CS5529-ASZR | IC ADC 16BIT W/6BIT LATCH 20SSOP |
| CS5530-ISZR | IC ADC 24BIT 1CH W/LNA 20-SSOP |
| CS5534-ASZR | IC ADC 24BIT 4CH W/LNA 24-SSOP |
| CS5534-BSZR | IC ADC 24BIT 4CH W/LNA 24SSOP |
相关代理商/技术参数 |
参数描述 |
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