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参数资料
| 型号： | DG221BDY-T1-E3 |
| 厂商： | Vishay Siliconix |
| 文件页数： | 4/7页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH QUAD SPST/CMOS 16SOIC |
| 标准包装： | 2,500 |
| 功能： | 开关 |
| 电路： | 4 x SPST - NC |
| 导通状态电阻： | 90 欧姆 |
| 电压电源： | 双电源 |
| 电压 - 电源，单路/双路(±)： | ±15V |
| 电流 - 电源： | 800µA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 带卷 (TR) |
DG221B
Vishay Siliconix
New Product
www.vishay.com
4
Document Number: 71616
S-03627—Rev. A, 23-Apr-01
TEST CIRCUITS
V–
FIGURE 2.
Switching Time
tr < 10 ns
tf < 10 ns
50%
0 V
3 V
tOFF
tON
VO
VS
90%
Logic
Input
Switch
Input
Switch
Output
CL (includes fixture and stray capacitance)
V+
IN
RL
RL + rDS(on)
VO = VS
S
D
–15 V
VO
GND
2 V
WR
CL
35 pF
RL
1 k
W
+15 V
FIGURE 3.
WR Switching Time
CL (includes fixture and stray capacitance)
V+
IN
RL
RL + rDS(on)
VO = VS
S
D
–15 V
VO
GND
2 V
WR
CL
35 pF
V–
RL
1 k
W
+15 V
0 V
tr < 10 ns
tf < 10 ns
0 V
3 V
tOFF , WR
tON, WR
VO
VS
90%
50%
0 V
3 V
WR
IN
VOUT
FIGURE 4.
WR Setup Conditions
tH = Hold Time
tS = Setup Time
tW = WR Pulse Width
The latches are level sensitive. When WR is held low the latches are transparent and the switches re-
spond to the digital inputs. The digital inputs are latched on the rising edge of WR.
tS
tH
tW
3 V
VOUT
WR
IN
50%
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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