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参数资料
型号： DK-DSP-3C120N
厂商： Altera
文件页数： 30/92页
文件大小： 0K
描述： KIT DEV DSP CYCLONE III EDITION
产品培训模块： Cyclone® III FPGA
Three Reasons to Use FPGA's in Industrial Designs
标准包装： 1
系列： Cyclone® III
类型： DSP
适用于相关产品： EP3C120
所含物品： 开发板，卡，设计样本，电源，线缆，软件和文档
产品目录页面： 605 (CN2011-ZH PDF)
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544-2538-ND - IC CYCLONE III FPGA 120K 484FBGA
544-2528-ND - IC CYCLONE III FPGA 120K 484FBGA
544-2394-ND - IC CYCLONE III FPGA 119K 780FBGA
544-2393-ND - IC CYCLONE III FPGA 119K 780FBGA
544-2392-ND - IC CYCLONE III FPGA 119K 780FBGA
544-2391-ND - IC CYCLONE III FPGA 119K 780FBGA
544-2390-ND - IC CYCLONE III FPGA 119K 484FBGA
更多...
其它名称： 544-2566
40 nm Device Portfolio
Stratix IV GX FPGA Features
Maximum Resource Count for Stratix IV GX FPGAs (0.9 V)
EP4SGX70
EP4SGX110
EP4SGX180
EP4SGX230
EP4SGX290
EP4SGX360
EP4SGX530
ALMs
LEs (K)
Registers 1
M9K memory blocks
M144K memory blocks
MLAB memory (Kb)
Embedded memory (Kb)
29,040
73
58,080
462
16
908
6,462
42,240
106
84,480
660
16
1,320
8,244
70,300
176
140,600
950
20
2,197
11,430
91,200
228
182,400
1,235
22
2,850
14,283
116,480
291
232,960
936
36
3,640
13,608
141,440
354
282,880
1,248
48
4,420
18,144
212,480
531
424,960
1,280
64
6,640
20,736
18 x 18 multipliers
384
512
920
1,288
832
1,040
2
1,024
Global clock networks
16
Regional clock networks
Periphery clock networks
PLLs
64
56
4
64
56
4
64
88
64
88
8
88
88
12
88
88
12
88
112
12
Design security
Others
I/O voltage levels supported (V)
I/O standards supported
3
Plug & Play Signal Integrity, Programmable Power Technology
1.2, 1.5, 1.8, 2.5, 3.3 4
LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15, Differential SSTL-18,
Differential SSTL-2, Differential HSTL-12, Differential HSTL-15, Differential HSTL-18, SSTL-15 (I and II),
SSTL-18 (I and II), SSTL-2 (I and II), 1.2 V HSTL (I and II), 1.5 V HSTL (I and II), 1.8 V HSTL (I and II)
Emulated LVDS channels,
1,100 Mbps
LVDS channels, 1,600 Mbps
(receive/transmit)
128
56/56
128
56/56
192
88/88
192
88/88
256
98/98
256
98/98
256
98/98
Embedded DPA circuitry
OCT
Series, parallel, and differential
Transceiver count
(8.5 Gbps/6.5 Gbps) 5
PCIe hard IP blocks
16/8
2
16/8
2
24/12
2
24/12
2
32/16
4
32/16
4
32/16
4
Memory devices supported
DDR3, DDR2, DDR, QDR II, QDR II+, RLDRAM 2, SDR
1
2
3
4
5
This is the base core logic register count. The ALM can support three registers when used in LUTREG mode, which increases the total register count by an additional 50 percent.
EP4SGX360N has 1,024 18x18 multipliers.
For EP4SGX70D and EP4SGX110D/F devices.
3.3 V compliant, requires a 3 V power supply.
The total transceiver count is the sum of 8.5 Gbps transceivers plus 6.5 Gbps transceivers.
28
Altera Product Catalog
?
2013
?
www.altera.com
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PDF描述
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相关代理商/技术参数
参数描述
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