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参数资料
| 型号： | DM240013-1 |
| 厂商： | Microchip Technology |
| 文件页数： | 152/278页 |
| 文件大小： | 0K |
| 描述： | KIT DEV MICROSTICK PIC24F KA/KL |
| 标准包装： | 1 |
| 系列： | MPLAB® |
| 类型： | MCU |
| 适用于相关产品： | PIC24F K 系列 |
| 所含物品： | 板，电缆，连接器，样品 |
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PIC24F16KA102 FAMILY
REGISTER 18-2:
UxSTA: UARTx STATUS AND CONTROL REGISTER
R/W-0
UTXISEL1
R/W-0
UTXINV
R/W-0
UTXISEL0
U-0
—
R/W-0, HC
UTXBRK
R/W-0
UTXEN
R-0, HSC
UTXBF
R-1, HSC
TRMT
bit 15
bit 8
R/W-0
URXISEL1
R/W-0
URXISEL0
R/W-0
ADDEN
R-1, HSC
RIDLE
R-0, HSC
PERR
R-0, HSC
FERR
R/C-0, HS
OERR
R-0, HSC
URXDA
bit 7
Legend:
C = Clearable bit
HC = Hardware Clearable bit
HS = Hardware Settable bit HSC = Hardware Settable/Clearable bit
bit 0
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15,13
bit 14
bit 12
bit 11
bit 10
bit 9
bit 8
bit 7-6
UTXISEL<1:0>: Transmission Interrupt Mode Selection bits
11 = Reserved; do not use
10 = Interrupt when a character is transferred to the Transmit Shift Register (TSR), and as a result,
the transmit buffer becomes empty
01 = Interrupt when the last character is shifted out of the Transmit Shift Register; all transmit operations
are completed
00 = Interrupt when a character is transferred to the Transmit Shift Register (this implies there is at
least one character open in the transmit buffer)
UTXINV: IrDA ? Encoder Transmit Polarity Inversion bit
If IREN = 0 :
1 = UxTX Idle ‘ 0 ’
0 = UxTX Idle ‘ 1 ’
If IREN = 1 :
1 = UxTX Idle ‘ 1 ’
0 = UxTX Idle ‘ 0 ’
Unimplemented: Read as ‘ 0 ’
UTXBRK: Transmit Break bit
1 = Send Sync Break on next transmission – Start bit, followed by twelve ‘ 0 ’ bits, followed by Stop bit;
cleared by hardware upon completion
0 = Sync Break transmission is disabled or completed
UTXEN: Transmit Enable bit
1 = Transmit is enabled, UxTX pin is controlled by UARTx
0 = Transmit is disabled, any pending transmission is aborted and buffer is reset. UxTX pin is controlled
by the PORT register.
UTXBF: Transmit Buffer Full Status bit (read-only)
1 = Transmit buffer is full
0 = Transmit buffer is not full, at least one more character can be written
TRMT: Transmit Shift Register Empty bit (read-only)
1 = Transmit Shift Register is empty and transmit buffer is empty (the last transmission has completed)
0 = Transmit Shift Register is not empty, a transmission is in progress or queued
URXISEL<1:0>: Receive Interrupt Mode Selection bits
11 = Interrupt is set on RSR transfer, making the receive buffer full (i.e., has 4 data characters)
10 = Interrupt is set on RSR transfer, making the receive buffer 3/4 full (i.e., has 3 data characters)
0x = Interrupt is set when any character is received and transferred from the RSR to the receive buffer;
receive buffer has one or more characters
DS39927C-page 152
? 2008-2011 Microchip Technology Inc.
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