参数资料
| 型号： | DS21Q55DK |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 11/32页 |
| 文件大小： | 0K |
| 描述： | KIT DESIGN FOR DS21Q55 |
| 标准包装： | 1 |
| 类型： | 收发器 |
| 适用于相关产品： | DS21Q55 |
| 所含物品： | 主板，子卡，软件和文档 |
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DS21Q55DK Quad T1/E1/J1 Transceiver Design Kit
Register Name: SYNC3
Register Description: DS21Q55 RSYNC Pin Setting
Register Offset: 0x0017
Bit #
Name
Default
7
RSOR1
0
6
RSOR0
0
5
—
—
4
—
—
3
R4IO
0
2
R3IO
0
1
R2IO
0
0
R1IO
0
Bit 0: DS21Q55 Port 1 RSYNC Setting (R1IO)
0 = RSYNC 1 is an output, tri-state corresponding FPGA driver pin (weak pulldown)
Bit 1: DS21Q55 Port 2 RSYNC Setting (R2IO)
0 = RSYNC 2 is an output, tri-state corresponding FPGA driver pin (weak pulldown)
Bit 2: DS21Q55 Port 3 RSYNC Setting (R3IO)
0 = RSYNC 3 is an output, tri-state corresponding FPGA driver pin (weak pulldown)
Bit 3: DS21Q55 Port 4 RSYNC Setting (R4IO)
0 = RSYNC 4 is an output, tri-state corresponding FPGA driver pin (weak pulldown)
Note: When driving RSYNCy with RSYNCx the corresponding DS21Q55 port should be configured such that
RSYNCx is an output (IOCR1.4 = 0) and RSYNCy is an input (IOCR1.4 = 1).
Table 6. RSYNCx Function Definition
RSOR1, RSOR0
00
01
10
11
MASTER RSYNC DESIGNATION
RSYNC 1 is used to drive other RSYNC pins (providing R X IO = 1)
RSYNC 2 is used to drive other RSYNC pins (providing R X IO = 1)
RSYNC 3 is used to drive other RSYNC pins (providing R X IO = 1)
RSYNC 4 is used to drive other RSYNC pins (providing R X IO = 1)
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参数描述 |
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