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参数资料
| 型号： | DS2252T |
| 英文描述： | Secure Microcontroller Module |
| 中文描述： | 安全微控制器模块 |
| 文件页数： | 10/15页 |
| 文件大小： | 257K |
| 代理商： | DS2252T |
DS2252T
10 of 15
AC CHARACTERISTICS: EXPANDED
BUS MODE TIMING SPECIFICATIONS
#
PARAMETER
1
Oscillator Frequency
2
ALE Pulse Width
3
Address Valid to ALE Low
4
Address Hold After ALE Low
14
RD
Pulse Width
15
WR
Pulse Width
(t
A
=0°C to70°C; V
CC
=5V
±
10%)
SYMBOL
MIN
1/t
CLK
1.0
t
ALPW
2t
CLK
-40
t
AVALL
t
CLK
-40
t
AVAAV
t
CLK
-35
t
RDPW
6t
CLK
-100
t
WRPW
6t
CLK
-100
MAX
16 (-16)
UNITS
MHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
16
RD
Low to Valid Data In
@ 12 MHz
@ 16 MHz
t
RDLDV
5t
CLK
-165
5t
CLK
-105
17
18
Data Hold after
RD
High
Data Float after
RD
High
ALE Low to Valid Data In
t
RDHDV
t
RDHDZ
0
2t
CLK
-70
8
CLK
-150
8t
CLK
-90
9t
CLK
-165
9t
CLK
-105
3t
CLK
+50
19
@ 12 MHz
@ 16 MHz
@ 12 MHz
@ 16 MHz
t
ALLVD
20
Valid Addr. to Valid Data In
t
AVDV
21
22
23
ALE Low to
RD
or
WR
Low
Address Valid to
RD
or
WR
Low
Data Valid to
WR
Going Low
Data Valid to
WR
High
t
ALLRDL
t
AVRDL
t
DVWRL
3t
CLK
-50
4t
CLK
-130
t
CLK
-60
7t
CLK
-150
7t
CLK
-90
t
CLK
-50
24
@ 12 MHz
@ 16 MHz
t
DVWRH
25
26
27
Data Valid after
WR
High
t
WRHDV
t
RDLAZ
t
RDHALH
RD
Low to Address Float
0
RD
or
WR
High to ALE High
t
CLK
-40
t
CLK
+50
EXPANDED DATA MEMORY READ CYCLE
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PDF描述 |
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参数描述 |
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