参数资料
| 型号： | DS26503DK |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 10/30页 |
| 文件大小： | 0K |
| 描述： | KIT DESIGN FOR DS26503 |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 1 |
| 主要目的： | 电信，BITS 元件 |
| 已用 IC / 零件： | DS26503 |
| 已供物品： | 板，CD |
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DS26503DK
Register Name: LEVEL4
Register Description: DS26503 Pin Settings (TSM, TITD)
Register Offset: 0x0014
Bit #
Name
Default
7
—
0
6
—
0
5
TSMtri
0
4
TSM_Lev
0
3
—
0
2
—
0
1
TITDtri
0
0
TITD_Lev
0
Note: This register is only valid in hardware mode (BIS[1:0] = 11), and is ignored for other modes.
Bits 5 and 4: DS26503 TSM Tri-State and Level (TSMtri and TSM_Lev)
00 = FPGA drives TSM with 0V
01 = FPGA drives TSM with 3.3V
1x = FPGA tri-states TSM pin
Bits 1 and 0: DS26503 TITD Tri-State and Level (TITDtri and TITD_Lev)
00 = FPGA drives TITD with 0V
01 = FPGA drives TITD with 3.3V
1x = FPGA tri-states TITD pin
Register Name: LEVEL5
Register Description: DS26503 Pin Settings (TCSS1, TCSS0)
Register Offset: 0x0015
Bit #
Name
Default
7
—
0
6
—
0
5
TCSS1tri
0
4
TCSS1_Lev
0
3
—
0
2
—
0
1
TCSS0tri
0
0
TCSS0_Lev
0
Note: This register is only valid in hardware mode (BIS[1:0] = 11), and is ignored for other modes.
Bits 5 and 4: DS26503 TCSS1 Tri-State and Level (TCSS1tri and TCSS1_Lev)
00 = FPGA drives with TCSS1 0V
01 = FPGA drives with TCSS1 3.3V
1x = FPGA tri-states TCSS1 pin
Bits 1 and 0: DS26503 TCSS0 Tri-State and Level (TCSS0tri and TCSS0_Lev)
00 = FPGA drives TCSS0 with 0V
01 = FPGA drives TCSS0 with 3.3V
1x = FPGA tri-states TCSS0 pin
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PDF描述 |
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参数描述 |
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| DS26503L+ | 功能描述:计时器和支持产品 E1-T1-J1 Bits Element RoHS:否 制造商:Micrel 类型:Standard 封装 / 箱体:SOT-23 内部定时器数量:1 电源电压-最大:18 V 电源电压-最小:2.7 V 最大功率耗散: 最大工作温度:+ 85 C 最小工作温度:- 40 C 封装:Reel |
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| DS26504 | 制造商:Maxim Integrated Products 功能描述:T1/E1/J1 ENH BITS ELEMENT LQFP - Trays |
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