参数资料
型号: DS26514G+
厂商: Maxim Integrated Products
文件页数: 111/305页
文件大小: 0K
描述: IC TXRX T1/E1/J1 4PORT 256-CSBGA
标准包装: 90
类型: 收发器
驱动器/接收器数: 4/4
规程: 以太网
电源电压: 3.14 V ~ 3.47 V
安装类型: 表面贴装
封装/外壳: 256-BGA,CSBGA
供应商设备封装: 256-CSBGA(17x17)
包装: 托盘
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DS26514 4-Port T1/E1/J1 Transceiver
19-5856; Rev 4; 5/11
199 of 305
10.4.2 Transmit Register Descriptions
10.4.2.1
Transmit HDLC-64 Register Definitions
Register Name:
THC1
Register Description:
Transmit HDLC-64 Control Register 1
Register Address:
110h + (200h x (n-1)) : where n = 1 to 4
Bit #
7
6
5
4
3
2
1
0
Name
NOFS
TEOML
THR
THMS
TFS
TEOM
TZSD
TCRCD
Default
0
Bit 7 : Number Of Flags Select (NOFS).
0 = send one flag between consecutive messages
1 = send two flags between consecutive messages
Bit 6 : Transmit End of Message and Loop (TEOML). To loop on a message, should be set to a one just before
the last data byte of an HDLC packet is written into the transmit FIFO. The message will repeat until the user clears
this bit or a new message is written to the transmit FIFO. If the host clears the bit, the looping message will
complete then flags will be transmitted until new message is written to the FIFO. If the host terminates the loop by
writing a new message to the FIFO the loop will terminate, one or two flags will be transmitted and the new
message will start. If not disabled via TCRCD, the transmitter will automatically append a two-byte CRC code to the
end of all messages.
Bit 5 : Transmit HDLC-64 Reset (THR). Will reset the transmit HDLC-64 controller and flush the transmit FIFO. An
abort followed by 7Eh or FFh flags/idle will be transmitted until a new packet is initiated by writing new data into the
FIFO. This is an acknowledged reset, that is, the host need only to set the bit and the DS26514 will clear it once
the reset operation is complete. Total time for the reset is less than 250
s.
0 = Normal operation
1 = Reset transmit HDLC-64 controller and flush the transmit FIFO
Bit 4 : Transmit HDLC-64 Mapping Select (THMS).
0 = Transmit HDLC-64 assigned to channels
1 = Transmit HDLC-64 assigned to FDL(T1 mode), Sa Bits(E1 mode). This mode must be enabled with
TCR2.7.
Bit 3 : Transmit Flag/Idle Select (TFS). This bit selects the inter-message fill character after the closing and
before the opening flags (7Eh).
0 = 7Eh
1 = FFh
Bit 2 : Transmit End of Message (TEOM). Should be set to a one just before the last data byte of an HDLC
packet is written into the transmit FIFO at THF. If not disabled via TCRCD, the transmitter will automatically append
a two byte CRC code to the end of the message.
Bit 1 : Transmit Zero Stuffer Defeat (TZSD). The Zero Stuffer function automatically inserts a zero in the
message field (between the flags) after 5 consecutive ones to prevent the emulation of a flag or abort sequence by
the data pattern. The receiver automatically removes (de-stuffs) any zero after 5 ones in the message field.
0 = enable the zero stuffer (normal operation)
1 = disable the zero stuffer
Bit 0 : Transmit CRC Defeat (TCRCD). A two-byte CRC code is automatically appended to the outbound
message. This bit can be used to disable the CRC function.
0 = enable CRC generation (normal operation)
1 = disable CRC generation
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DS26518 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:8-Port T1/E1/J1 Transceiver
DS26518DK 功能描述:网络开发工具 DS26518 Dev Kit RoHS:否 制造商:Rabbit Semiconductor 产品:Development Kits 类型:Ethernet to Wi-Fi Bridges 工具用于评估:RCM6600W 数据速率:20 Mbps, 40 Mbps 接口类型:802.11 b/g, Ethernet 工作电源电压:3.3 V