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参数资料
| 型号： | DS26528DK |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 55/276页 |
| 文件大小： | 0K |
| 描述： | KIT DESIGN FOR DS26528 |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 设计资源： | DS26528DK Gerber Files |
| 标准包装： | 1 |
| 主要目的： | 电信，调帧器和线路接口装置（LIU） |
| 已用 IC / 零件： | G575DS26528 |
| 已供物品： | 板，子卡，线缆，CD，文档 |
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DS26528 Octal T1/E1/J1 Transceiver
148 of 276
Register Name:
RCR3
Register Description:
Receive Control Register 3
Register Address:
083h + (200h x n): where n = 0 to 7, for Ports 1 to 8
Bit #
7
6
5
4
3
2
1
0
Name
IDF
—
RSERC
—
PLB
FLB
Default
0
Bit 7: Input Data Format (IDF).
0 = bipolar data is expected at RTIP and RRING (either AMI or B8ZS)
1 = NRZ data is expected at RTIP. The BPV counter will be disabled and RRING will be ignored by the
DS26528.
Bit 5: RSER Control (RSERC).
0 = allow RSER to output data as received under all conditions (normal operation)
1 = force RSER to one under loss of frame alignment conditions
Bit 1: Payload Loopback (PLB).
0 = loopback disabled
1 = loopback enabled
When PLB is enabled, the following will occur:
1) Data will be transmitted from the TTIP and TRING pins synchronous with RCLK instead of TCLK.
2) All the receive-side signals will continue to operate normally.
3) The TCHCLK and TCHBLK signals are forced low.
4) Data at the TSER, TDATA, and TSIG pins is ignored.
5) The TLCLK signal will become synchronous with RCLK instead of TCLK.
In a PLB situation, the DS26528 loops the 192 bits (248 for E1) of payload data (with BPVs corrected) from the
receive section back to the transmit section. The transmitter follows the frame alignment provided by the receiver.
The receive frame boundary is automatically fed into the transmit section, such that the transmit frame position is
locked to the receiver (i.e., TSYNC is sourced from RSYNC). The FPS framing pattern, CRC-6 calculation, and the
FDL bits (FAS word, Si, Sa, E-bits, and CRC-4 for E1) are not looped back. Rather, they are reinserted by the
DS26528 (i.e., the transmit section will modify the payload as if it was input at TSER).
Bit 0: Framer Loopback (FLB).
0 = loopback disabled
1 = loopback enabled
This loopback is useful in testing and debugging applications. In FLB, the DS26528 loops data from the transmit
side back to the receive side. When FLB is enabled, the following will occur:
1) (T1 mode) An unframed all-ones code will be transmitted at TTIP and TRING.
(E1 mode) Normal data will be transmitted at TTIP and TRING.
2) Data at RTIP and RRING will be ignored.
3) All receive-side signals will take on timing synchronous with TCLK instead of RCLK.
4) Note that it is not acceptable to have RCLK tied to TCLK during this loopback because this will cause an
unstable condition.
相关PDF资料 |
PDF描述 |
|---|---|
| ESM12DRTN-S13 | CONN EDGECARD 24POS .156 EXTEND |
| M3TFK-1636J | IDC CABLE - MSD16K/MC16G/MCF16K |
| EMM10DRTI-S13 | CONN EDGECARD 20POS .156 EXTEND |
| M3TGK-1636J | IDC CABLE - MSD16K/MC16G/MCS16K |
| ESM12DRTH-S13 | CONN EDGECARD 24POS .156 EXTEND |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS26528G | 功能描述:网络控制器与处理器 IC 8-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| DS26528G+ | 功能描述:网络控制器与处理器 IC 8-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| DS26528GA2 | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| DS26528GA3 | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| DS26528GA4 | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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