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参数资料
| 型号： | DSP56F826BU80 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 35/56页 |
| 文件大小： | 0K |
| 描述： | IC DSP 80MHZ 64KB FLASH 100LQFP |
| 标准包装： | 90 |
| 系列： | 56F8xx |
| 核心处理器： | 56800 |
| 芯体尺寸： | 16-位 |
| 速度： | 80MHz |
| 连通性： | EBI/EMI，SCI，SPI，SSI |
| 外围设备： | POR，WDT |
| 输入/输出数： | 46 |
| 程序存储器容量： | 67KB（33.5K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4.5K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 2.25 V ~ 2.75 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-LQFP |
| 包装： | 托盘 |
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56F826 Technical Data, Rev. 14
40
Freescale Semiconductor
3.10 Synchronous Serial Interface (SSI) Timing
Table 3-13 SSI Master Mode1 Switching Characteristics
Operating Conditions: VSSIO = VSS = VSSA = 0V, VDDA = VDDIO = 3.0–3.6V, VDD = 2.25–2.75V, TA = –40° to +85°C, CL ≤ 50pF, fop = 80MHz
1. Master mode is internally generated clocks and frame syncs
Parameter
Symbol
Min
Typ
Max
Units
STCK frequency
fs
102
2. Max clock frequency is IP_clk/4 = 40MHz / 4 = 10MHz for an 80MHz part.
MHz
STCK period3
tSCKW
100
—
ns
STCK high time
tSCKH
504
——
ns
STCK low time
tSCKL
504
——
ns
Output clock rise/fall time (STCK, SRCK)
—
4
—ns
Delay from STCK high to STFS (bl) high - Master5
tTFSBHM
0.1
—
0.5
ns
Delay from STCK high to STFS (wl) high - Master5
tTFSWHM
0.1
—
0.5
ns
Delay from SRCK high to SRFS (bl) high - Master5
tRFSBHM
0.6
—
1.3
ns
Delay from SRCK high to SRFS (wl) high - Master5
tRFSWHM
0.6
—
1.3
ns
Delay from STCK high to STFS (bl) low - Master5
tTFSBLM
-1.0
—
-0.1
ns
Delay from STCK high to STFS (wl) low - Master5
tTFSWLM
-1.0
—
-0.1
ns
Delay from SRCK high to SRFS (bl) low - Master5
tRFSBLM
-0.1
—
0
ns
Delay from SRCK high to SRFS (wl) low - Master5
tRFSWLM
-0.1
—
0
ns
STCK high to STXD enable from high impedance - Master
tTXEM
20
—
22
ns
STCK high to STXD valid - Master
tTXVM
24
—
26
ns
STCK high to STXD not valid - Master
tTXNVM
0.1
—
0.2
ns
STCK high to STXD high impedance - Master
tTXHIM
24
—
25.5
ns
SRXD Setup time before SRCK low - Master
tSM
4—
—
ns
SRXD Hold time after SRCK low - Master
tHM
4—
—
ns
Synchronous Operation (in addition to standard internal clock parameters)
SRXD Setup time before STCK low - Master
tTSM
4—
—
SRXD Hold time after STCK low - Master
tTHM
4—
—
相关PDF资料 |
PDF描述 |
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参数描述 |
|---|---|
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