参数资料
型号: DSPIC33FJ12MC202-I/SP
厂商: Microchip Technology
文件页数: 76/155页
文件大小: 0K
描述: IC DSPIC MCU/DSP 12K 28DIP
产品培训模块: Asynchronous Stimulus
特色产品: PIC24FJ/33FJ MCUs & dsPIC? DSCs
标准包装: 15
系列: dsPIC™ 33F
核心处理器: dsPIC
芯体尺寸: 16-位
速度: 40 MIP
连通性: I²C,IrDA,SPI,UART/USART
外围设备: 高级欠压探测/复位,电机控制 PWM,QEI,POR,PWM,WDT
输入/输出数: 21
程序存储器容量: 12KB(12K x 8)
程序存储器类型: 闪存
RAM 容量: 1K x 8
电压 - 电源 (Vcc/Vdd): 3 V ~ 3.6 V
数据转换器: A/D 6x10b/12b
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 28-DIP(0.300",7.62mm)
包装: 管件
产品目录页面: 651 (CN2011-ZH PDF)
配用: AC164337-ND - MODULE SOCKET FOR PM3 40DIP
DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32
PIC18F2XK20/4XK20
DS41303G-page 300
2010 Microchip Technology Inc.
23.1
Configuration Bits
The Configuration bits can be programmed (read as
‘0’) or left unprogrammed (read as ‘1’) to select various
device configurations. These bits are mapped starting
at program memory location 300000h.
The user will note that address 300000h is beyond the
user program memory space. In fact, it belongs to the
configuration memory space (300000h-3FFFFFh), which
can only be accessed using table reads and table writes.
Programming the Configuration registers is done in a
manner similar to programming the Flash memory. The
WR bit in the EECON1 register starts a self-timed write
to the Configuration register. In normal operation mode,
a TBLWT instruction with the TBLPTR pointing to the
Configuration register sets up the address and the data
for the Configuration register write. Setting the WR bit
starts a long write to the Configuration register. The
Configuration registers are written a byte at a time. To
write or erase a configuration cell, a TBLWT instruction
can write a ‘1’ or a ‘0’ into the cell. For additional details
on Flash programming, refer to Section 6.5 “Writing
TABLE 23-1:
CONFIGURATION BITS AND DEVICE IDs
File Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Default/
Unprogrammed
Value
300001h
CONFIG1H
IESO
FCMEN
FOSC3
FOSC2
FOSC1
FOSC0
00-- 0111
300002h
CONFIG2L
BORV1
BORV0
BOREN1
BOREN0
PWRTEN
---1 1111
300003h
CONFIG2H
WDTPS3
WDTPS2
WDTPS1
WDTPS0
WDTEN
---1 1111
300005h
CONFIG3H MCLRE
HFOFST
LPT1OSC PBADEN
CCP2MX
1--- 1011
300006h
CONFIG4L
DEBUG
XINST
—LVP
—STVREN
10-- -1-1
300008h
CONFIG5L
—CP3(1)
CP2(1)
CP1
CP0
---- 1111
300009h
CONFIG5H
CPD
CPB
11-- ----
30000Ah
CONFIG6L
—WRT3(1)
WRT2(1)
WRT1
WRT0
---- 1111
30000Bh
CONFIG6H
WRTD
WRTB
WRTC
111- ----
30000Ch
CONFIG7L
—EBTR3(1)
EBTR2(1)
EBTR1
EBTR0
---- 1111
30000Dh
CONFIG7H
—EBTRB
-1-- ----
3FFFFEh
DEVID1(2)
DEV2
DEV1
DEV0
REV4
REV3
REV2
REV1
REV0
qqqq qqqq(2)
3FFFFFh
DEVID2(2)
DEV10
DEV9
DEV8
DEV7
DEV6
DEV5
DEV4
DEV3
0000 1100
Legend:
x
= unknown, u = unchanged, – = unimplemented, q = value depends on condition.
Shaded cells are unimplemented, read as ‘0’.
Note
1:
Implemented but not used in PIC18FX3K20 and PIC18FX4K20 devices; maintain this bit set.
2:
See Register 23-12 for DEVID1 values. DEVID registers are read-only and cannot be programmed by the user.
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