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参数资料
| 型号： | EDI2AG272129V10D1 |
| 英文描述： | 2x128Kx72, 3.3V,10ns, Sync/Sync Burst SRAM Module(2x128Kx72, 3.3V，10ns,同步/同步脉冲静态RAM模块) |
| 中文描述： | 2x128Kx72，3.3伏，10纳秒，同步/同步突发静态存储器模块（2x128Kx72，3.3伏，10纳秒，同步/同步脉冲静态内存模块） |
| 文件页数： | 8/11页 |
| 文件大小： | 257K |
| 代理商： | EDI2AG272129V10D1 |
EDI2AG272129V
6
White Electronic Designs Corporation (508) 366-5151 www.whiteedc.com
SYNCHRONOUS ONLY READ CYCLE
READ CYCLE TIMING PARAMETERS
*TBD
8.5ns
9ns
10ns
12ns
Description
Sym
Min
Max
Min
Max
Min
Max
Min
Max
Units
Clock Cycle Time
tKHKH
**10
12
15
ns
Clock High Time
tKHKL
**
4
5
ns
Clock Low Time
tKLKH
**
4
5
ns
Clock to Output Valid
tKHQV
**
9
10
12
ns
Clock to Output Invalid
tKHQX1
**
3
ns
Clock to Output Low-Z
tKHQX
**
2
ns
Output Enable to Output Valid
tGLQV
**
4
5
ns
Output Enable to Output Low-Z
tGLQX
**
0
ns
Output Enable to Output High-Z
tGHQZ
**
4
5
ns
Address Setup
tAVKH
*
2.5
ns
Bank Enable Setup
tEVKH
*
2.5
ns
Address Hold
tKHAX
*
1.0
ns
Bank Enable Hold
tKHEX
*
1.0
ns
tKHQX
DQ
Read Cycle
Q(Addr 1)
Q(Addr 2)
tKHQZ
GW\
OE\
ADDR
CE\
CLK
tKHQV
Addr 1
Addr 2
Addr 1
tKHKH
tKLKH
tKHKL
tGLQX
Back to Back Read
tKHQX1
tGLQV
tKHAX
tAVKH
Ex\
G\
相关PDF资料 |
PDF描述 |
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参数描述 |
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| EDI2AG272129V9D1 | 制造商:WEDC 制造商全称:White Electronic Designs Corporation 功能描述:2 Megabyte Sync/Sync Burst, Small Outline DIMM |
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