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参数资料
| 型号： | EFM32-TG108F32-SK |
| 厂商： | Energy Micro |
| 文件页数： | 80/136页 |
| 文件大小： | 0K |
| 描述： | IC MICRO KIT GECKO 24QFN |
| 标准包装： | 1 |
| 系列： | Tiny Gecko |
| 套件类型： | 微控制器 |
| 值： | 2 件 - 闪存 - 32KB |
| 包装： | 纸板盒 |
| 安装类型： | 表面贴装 |
| 包括封装： | 24-QFN |
| 工具箱内容： | (2) 914-1032-2-ND - MCU 32BIT 32KB FLASH 24-QFN |
| 其它名称： | 914-1025 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页当前第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页
...the world's most energy friendly microcontrollers
2011-02-04 - d0002_Rev1.00
48
www.energymicro.com
The value to load or store can be a byte, halfword, word, or two words. Bytes and halfwords can either
be signed or unsigned. See Section 3.3.5 (p. 42) .
Table 3.6 (p. 48) shows the ranges of offset for immediate, pre-indexed and post-indexed forms.
Table 3.6. Offset ranges
Instruction type
Immediate offset
Pre-indexed
Post-indexed
Word, halfword, signed
halfword, byte, or signed byte
#255 to 4095
#255 to 255
Two words
multiple of 4 in the
range #1020 to 1020
multiple of 4 in the
range #1020 to 1020
multiple of 4 in the
range #1020 to 1020
3.4.2.3 Restrictions
For load instructions:
Rt can be SP or PC for word loads only
Rt must be different from Rt2 for two-word loads
Rn must be different from Rt and Rt2 in the pre-indexed or post-indexed forms.
When Rt is PC in a word load instruction:
bit[0] of the loaded value must be 1 for correct execution
a branch occurs to the address created by changing bit[0] of the loaded value to 0
if the instruction is conditional, it must be the last instruction in the IT block.
For store instructions:
Rt can be SP for word stores only
Rt must not be PC
Rn must not be PC
Rn must be different from Rt and Rt2 in the pre-indexed or post-indexed forms.
3.4.2.4 Condition flags
These instructions do not change the flags.
3.4.2.5 Examples
LDR
R8, [R10]
; Loads R8 from the address in R10.
LDRNE
R2, [R5, #960]!
; Loads (conditionally) R2 from a word
; 960 bytes above the address in R5, and
; increments R5 by 960.
STR
R2, [R9,#const#struc]
; const#struc is an expression evaluating
; to a constant in the range 0#4095.
STRH
R3, [R4], #4
; Store R3 as halfword data into address in
; R4, then increment R4 by 4
LDRD
R8, R9, [R3, #0x20]
; Load R8 from a word 32 bytes above the
; address in R3, and load R9 from a word 36
; bytes above the address in R3
STRD
R0, R1, [R8], #-16
; Store R0 to address in R8, and store R1 to
; a word 4 bytes above the address in R8,
; and then decrement R8 by 16.
3.4.3 LDR and STR, register offset
Load and Store with register offset.
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