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参数资料
| 型号： | EL4511CU |
| 厂商： | Intersil |
| 文件页数： | 16/24页 |
| 文件大小： | 0K |
| 描述： | IC VID SYNC SEPARATR HDTV 24QSOP |
| 标准包装： | 55 |
| 类型： | 同步分离器 |
| 应用： | HDTV，投影仪，机顶盒 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 24-QSOP |
| 包装： | 管件 |
23
FN7009.8
November 12, 2010
FIGURE 11. SERIAL INTERFACE TIMING DIAGRAM
7:6
CountsPerField <9:8>
-
Crystal clock periods per field: Bits 9:8. (see description)
5
SyncLock
As sync lock pin.
4
CPFValid
-
Counts per field valid. Set L if read occurs during an update.
3
SetBiLevel
-
Lo: Tri-level mode; Hi: Bi-level mode.
2
VinSyncDet
-
Indicates vertical sync on VERTIN successfully acquired.
1
VinPolarity
-
VERTIN polarity setting: Observe.
0
HPolarity
-
HIN polarity setting: Observe.
16
Oscillator Settings Observe 2
R
4
RateLocked
-
Indicates line rate successfully acquired.
3
ALOS
-
Analog loss of signal, measured via S/H. H indicates analog
signal amplitude is below threshold.
TABLE 5. SERIAL INTERFACE REGISTER BIT ALLOCATIONS (Continued)
REGISTER
NUMBER
REGISTER
BIT
SIGNAL NAME
TYPE
RESET
VALUE
DESCRIPTION AND COMMENTS
WRITE TO REGISTER OF EL4511 (WRITE INDICATED WITH ADDRESS = 0XXXXXXX)
READ FROM REGISTER OF EL4511 (READ INDICATED WITH ADDRESS = 1XXXXXXX)
SDENB
SCL
SDA
SDENB
SCL
SDA
1
0
t(SCL)HI t(SCL)LO
(1/F)*SCL
t(SCL)HI t(SCL)LO
(1/F)*SCL
td(SDA)OUT
t(SDA)
SETUP
t(SDA)
HOLD
16
LSB
td(SDENB)
td(SDENB)STOP
t(SDENB)
IDLE
t(SDENB)
IDLE
16
D0
td(SDA)
OFF
REGISTER ADDRESS 7 BITS
OUTPUT DATA 8 BITS
t(SDA)
SETUP
t(SDA)
HOLD
REGISTER ADDRESS 7 BITS
INPUT DATA 8 BITS
td(SCL)
START
td(SCL)
START
D7
“I”=READ
“0”=WRITE
EL4511
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