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参数资料
| 型号： | ENC424J600T-I/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 3/168页 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET CTRLR W/SPI 44-TQFP |
| 视频文件： | Fast 100 Mbps Ethernet PICtail Plus Overview |
| 标准包装： | 1,200 |
| 控制器类型： | 以太网控制器（IEEE 802.3） |
| 接口： | SPI |
| 电源电压： | 3 V ~ 3.6 V |
| 电流 - 电源： | 96mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-TQFP |
| 供应商设备封装： | 44-TQFP（10x10） |
| 包装： | 带卷 (TR) |
| 配用： | AC164132-ND - BOARD DAUGHTER PICTAIL ETHERNET |
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PIC18F2220/2320/4220/4320
DS39599G-page 98
2007 Microchip Technology Inc.
9.5
RCON Register
The RCON register contains bits used to determine the
cause of the last Reset or wake-up from power-
managed mode. RCON also contains the bit that
enables interrupt priorities (IPEN).
REGISTER 9-10:
RCON: RESET CONTROL REGISTER
R/W-0
U-0
R/W-1
R-1
R/W-0
IPEN
—
—RI
TO
PD
POR
BOR
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
IPEN: Interrupt Priority Enable bit
1 = Enable priority levels on interrupts
0 = Disable priority levels on interrupts (PIC16CXXX Compatibility mode)
bit 6-5
Unimplemented: Read as ‘0’
bit 4
RI: RESET Instruction Flag bit
1 = The RESET instruction was not executed (set by firmware only)
0 = The RESET instruction was executed causing a device Reset (must be set in software after a
Brown-out Reset occurs)
bit 3
TO: Watchdog Time-out Flag bit
1 = Set by power-up, CLRWDT instruction or SLEEP instruction
0 = A WDT time-out occurred
bit 2
PD: Power-Down Detection Flag bit
1 = Set by power-up or by the CLRWDT instruction
0 = Cleared by execution of the SLEEP instruction
bit 1
POR: Power-on Reset Status bit
1 = A Power-on Reset has not occurred (set by firmware only)
0 = A Power-on Reset occurred (must be set in software after a Power-on Reset occurs)
bit 0
BOR: Brown-out Reset Status bit
1 = A Brown-out Reset has not occurred (set by firmware only)
0 = A Brown-out Reset occurred (must be set in software after a Brown-out Reset occurs)
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