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参数资料
| 型号： | EP1C6T144I8ES |
| 厂商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 气旋的FPGA系列数据手册 |
| 文件页数： | 85/104页 |
| 文件大小： | 763K |
| 代理商： | EP1C6T144I8ES |
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Altera Corporation
January 2007
4–15
Preliminary
Timing Model
External Timing Parameters
External timing parameters are specified by device density and speed
grade.
Figure 4–2
shows the timing model for bidirectional IOE pin
timing. All registers are within the IOE.
Table 4–27. M4K Block Internal Timing Microparameters
Symbol
-6
-7
-8
Unit
Min
Max
Min
Max
Min
Max
t
M4KRC
4,379
5,035
5,691
ps
t
M4KWC
2,910
3,346
3,783
ps
t
M4KWERESU
72
82
93
ps
t
M4KWEREH
43
49
55
ps
t
M4KBESU
72
82
93
ps
t
M4KBEH
43
49
55
ps
t
M4KDATAASU
72
82
93
ps
t
M4KDATAAH
43
49
55
ps
t
M4KADDRASU
72
82
93
ps
t
M4KADDRAH
43
49
55
ps
t
M4KDATABSU
72
82
93
ps
t
M4KDATABH
43
49
55
ps
t
M4KADDRBSU
72
82
93
ps
t
M4KADDRBH
43
49
55
ps
t
M4KDATACO1
621
714
807
ps
t
M4KDATACO2
4,351
5,003
5,656
ps
t
M4KCLKHL
1,234
1,562
1,818
ps
t
M4KCLR
286
328
371
ps
Table 4–28. Routing Delay Internal Timing Microparameters
Symbol
-6
-7
-8
Unit
Min
Max
Min
Max
Min
Max
t
R4
261
300
339
ps
t
C4
338
388
439
ps
t
LOCAL
244
281
318
ps
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PDF描述 |
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