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参数资料
| 型号： | EP1K50FC484-2X |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 现场可编程门阵列（FPGA） |
| 文件页数： | 61/86页 |
| 文件大小： | 1263K |
| 代理商： | EP1K50FC484-2X |
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64
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Table 34. EP1K10 Device Interconnect Timing Microparameters
Note (1), (2)
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tDIN2IOE
2.3
2.7
3.6
ns
tDIN2LE
0.8
1.1
1.4
ns
tDIN2DATA
1.1
1.4
1.8
ns
tDCLK2IOE
2.3
2.7
3.6
ns
tDCLK2LE
0.8
1.1
1.4
ns
tSAMELAB
0.1
0.2
ns
tSAMEROW
1.8
2.1
2.9
ns
tSAMECOLUMN
0.3
0.4
0.7
ns
tDIFFROW
2.1
2.5
3.6
ns
tTWOROWS
3.9
4.6
6.5
ns
tLEPERIPH
3.3
3.7
4.8
ns
tLABCARRY
0.3
0.4
0.5
ns
tLABCASC
0.9
1.0
1.4
ns
Table 35. EP1K10 External Timing Parameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tDRR
7.5
9.5
12.5
ns
tINSU (3), (4)
2.4
2.7
3.6
ns
tINH (3), (4)
0.0
ns
tOUTCO (3), (4)
2.0
6.6
2.0
7.8
2.0
9.6
ns
tINSU (5), (4)
1.4
1.7
–
ns
tINH (5), (4)
0.5
5.1
0.5
6.4
–
ns
tOUTCO (5), (4)
0.0
–
ns
tPCISU (4)
3.0
4.2
6.4
ns
tPCIH (4)
0.0
–
ns
tPCICO (4)
2.0
6.0
2.0
7.5
2.0
10.2
ns
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PDF描述 |
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参数描述 |
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