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参数资料
| 型号： | EP20K1000E |
| 厂商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可编程逻辑器件系列 |
| 文件页数： | 45/117页 |
| 文件大小： | 570K |
| 代理商： | EP20K1000E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页当前第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页
Altera Corporation
45
APEX 20K Programmable Logic Device Family Data Sheet
Figure 29. APEX 20KE I/O Banks
Notes to
Figure 29
:
(1)
For more information on placing I/O pins in LVDS blocks, refer to the
Guidelines for
Using LVDS Blocks
section in
Application Note 120 (Using LVDS in APEX 20KE
Devices
).
(2)
If the LVDS input and output blocks are not used for LVDS, they can support all of
the I/O standards and can be used as input, output, or bidirectional pins with
V
CCIO
set to 3.3 V, 2.5 V, or 1.8 V.
Power Sequencing & Hot Socketing
Because APEX 20K and APEX 20KE devices can be used in a mixed-
voltage environment, they have been designed specifically to tolerate any
possible power-up sequence. Therefore, the V
CCIO
and V
CCINT
power
supplies may be powered in any order.
f
For more information, please refer to the “Power Sequencing
Considerations” section in the
Configuring APEX 20KE & APEX 20KC
Devices
chapter of the
Configuration Devices Handbook
.
Signals can be driven into APEX 20K devices before and during power-up
without damaging the device. In addition, APEX 20K devices do not drive
out during power-up. Once operating conditions are reached and the
device is configured, APEX 20K and APEX 20KE devices operate as
specified by the user.
LVDS/LVPECL
Inpu
t
Blo
c
k (
2
)
(1)
LVDS/LVPECL
Ou
t
pu
t
Blo
c
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2
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(1)
R
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gul
ar
I/O Blo
c
k
s
Suppo
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■
LVTTL
■
LVCMOS
■
2
.5 V
■
1.8 V
■
3.3 V PCI
■
LVPECL
■
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I
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■
SSTL-
2
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ass
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I
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I/O B
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I/O B
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nk 5
I/O B
a
nk 6
I/O B
a
nk 7
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PDF描述 |
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| EP20K1000EBC652-1ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
| EP20K1000EBC652-1X | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 2560 Macros 488 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K1000EBC652-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 2560 Macros 488 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K1000EBC652-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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