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参数资料
| 型号： | EP20K100EFI784-2 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PBGA784 |
| 文件页数： | 53/65页 |
| 文件大小： | 781K |
| 代理商： | EP20K100EFI784-2 |
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Altera Corporation
79
Preliminary Information
APEX 20K Programmable Logic Device Family Data Sheet
Notes:
(1)
This parameter is measured without use of the ClockLock or ClockBoost circuits.
(2)
This parameter is measured with use of the ClockLock or ClockBoost circuits.
Table 20. External Bidirectional Timing Parameters
Symbol
Parameter
Condition
tINSUBIDIR
Setup time for bidirectional pins with global clock at same-row or same-
column LE register
tINHBIDIR
Hold time for bidirectional pins with global clock at same-row or same-
column LE register
tOUTCOBIDIR
Clock-to-output delay for bidirectional pins with global clock at IOE register
C1 = 35 pF
tXZBIDIR
Synchronous IOE output buffer disable delay
C1 = 35 pF
tZXBIDIR
Synchronous IOE output buffer enable delay, slow slew rate = off
C1 = 35 pF
Table 21. EP20K100 External Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSU (1)
2.1
2.5
3.0
ns
tINH (1)
0.0
ns
tOUTCO (1)
2.0
4.0
2.0
4.1
2.0
5.5
ns
tINSU (2)
2.1
2.5
3.0
ns
tINH (2)
0.0
ns
tOUTCO (2)
0.5
3.0
0.5
3.1
0.5
4.5
ns
相关PDF资料 |
PDF描述 |
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参数描述 |
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| EP20K100EQC208-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 151 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K100EQC208-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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