参数资料
| 型号： | EP20K160EFC484-1 |
| 厂商： | Altera |
| 文件页数： | 40/117页 |
| 文件大小： | 0K |
| 描述： | IC APEX 20KE FPGA 160K 484-FBGA |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 标准包装： | 60 |
| 系列： | APEX-20K® |
| LAB/CLB数： | 640 |
| 逻辑元件/单元数： | 6400 |
| RAM 位总计： | 81920 |
| 输入/输出数： | 316 |
| 门数： | 404000 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 484-BGA |
| 供应商设备封装： | 484-FBGA（23x23） |
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Altera Corporation
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APEX 20K Programmable Logic Device Family Data Sheet
Figure 16. APEX 20K Parallel Expanders
Embedded
System Block
The ESB can implement various types of memory blocks, including
dual-port RAM, ROM, FIFO, and CAM blocks. The ESB includes input
and output registers; the input registers synchronize writes, and the
output registers can pipeline designs to improve system performance. The
ESB offers a dual-port mode, which supports simultaneous reads and
writes at two different clock frequencies. Figure 17 shows the ESB block
diagram.
Figure 17. ESB Block Diagram
32 Signals from
Local Interconnect
To Next
Macrocell
From
Previous
Macrocell
Product-
Term
Select
Matrix
Product-
Term
Select
Matrix
Macrocell
Product-
Term Logic
Macrocell
Product-
Term Logic
Parallel
Expander Switch
Parallel
Expander Switch
wraddress[]
data[]
wren
inclock
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inaclr
rdaddress[]
q[]
rden
outclock
outclocken
outaclr
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PDF描述 |
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参数描述 |
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| EP20K160EFC484-1X | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 640 Macro 316 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K160EFC484-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 640 Macro 316 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K160EFC484-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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