参数资料
| 型号： | EP4SGX290FH29I4 |
| 厂商： | Altera |
| 文件页数： | 19/82页 |
| 文件大小： | 0K |
| 描述： | IC STRATIX IV FPGA 290K 780HBGA |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 标准包装： | 3 |
| 系列： | Stratix® IV GX |
| LAB/CLB数： | 11648 |
| 逻辑元件/单元数： | 291200 |
| RAM 位总计： | 17661952 |
| 输入/输出数： | 289 |
| 电源电压： | 0.87 V ~ 0.93 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 780-BBGA 裸露焊盘 |
| 供应商设备封装： | 780-HBGA（33x33） |
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Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–18
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
Data rate (Double
width, PMA
Direct) (23)
—
1000
—
6500
1000
—
6500
1000
—
6375
Mbps
Absolute VMAX for a
receiver pin (6)
—
1.6
—
1.6
—
1.6
V
Operational VMAX for
a receiver pin
—
1.5
—
1.5
—
1.5
V
Absolute VMIN for a
receiver pin
—
-0.4
—
-0.4
—
-0.4
—
V
Maximum
peak-to-peak
differential input
voltage VID (diff p-p)
before device
configuration
—
1.6
—
1.6
—
1.6
V
Maximum peak-to-
peak differential
input voltage VID
(diff p-p) after
device configuration
VICM = 0.82 V
setting
—
2.7
—
2.7
—
2.7
V
VICM =1.1 V
setting (7)
—
1.6
—
1.6
—
1.6
V
Minimum
differential eye
opening at receiver
serial input pins (20)
Data Rate =
600 Mbps to
5 Gbps
Equalization = 0
DC gain = 0 dB
100
—
100
—
165
—
mV
Data Rate
>5Gbps
Equalization = 0
DC gain = 0 dB
165
—
165
—
165
—
mV
VICM
VICM = 0.82 V
setting
820 ± 10%
mV
VICM = 1.1 V
setting (7)
1100 ± 10%
mV
Receiver DC
Coupling Support
—
For more information about receiver DC coupling support, refer to the “DC-
Coupled Links” section in the Transceiver Architecture in Stratix IV Devices chapter.
Differential on-chip
termination
resistors
85
setting
85 ± 20%
100
setting
100 ± 20%
120
setting
120 ± 20%
150-
setting
150 ± 20%
Table 1–23. Transceiver Specifications for Stratix IV GX Devices (Part 3 of 9)
Symbol/
Description
Conditions
–2 Commercial
Speed Grade
–3 Commercial/
Industrial and
–2× Commercial
Speed Grade (1)
–3 Military (2)
and –4
Commercial/Industrial
Speed Grade
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相关PDF资料 |
PDF描述 |
|---|---|
| HSM44DSAH | CONN EDGECARD 88POS R/A .156 SLD |
| HMM44DSAH | CONN EDGECARD 88POS R/A .156 SLD |
| EP4SGX290FH29C3 | IC STRATIX IV FPGA 290K 780HBGA |
| EMC60DRYI-S93 | CONN EDGECARD 120PS DIP .100 SLD |
| 93LC46AT-I/MC | IC EEPROM 1KBIT 2MHZ 8DFN |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EP4SGX290FH29I4N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix IV GX 11648 LABs 289 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP4SGX290HF35C2 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix IV GX 11648 LABs 564 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP4SGX290HF35C2N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix IV GX 11648 LABs 564 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP4SGX290HF35C3 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix IV GX 11648 LABs 564 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP4SGX290HF35C3N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix IV GX 11648 LABs 564 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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