参数资料
| 型号： | EPF8452ALC84-4 |
| 厂商： | Altera |
| 文件页数： | 10/62页 |
| 文件大小： | 0K |
| 描述： | IC FLEX 8000A FPGA 4K 84-PLCC |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 标准包装： | 75 |
| 系列： | FLEX 8000 |
| LAB/CLB数： | 42 |
| 逻辑元件/单元数： | 336 |
| 输入/输出数： | 68 |
| 门数： | 4000 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 84-LCC（J 形引线） |
| 供应商设备封装： | 84-PLCC（29.31x29.31） |
| 产品目录页面： | 602 (CN2011-ZH PDF) |
| 其它名称： | 544-2257-5 |
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18
Altera Corporation
FLEX 8000 Programmable Logic Device Family Data Sheet
Figure 9. FLEX 8000 Device Interconnect Resources
Each LAB is named according to its physical row (A, B, C, etc.) and column (1, 2, 3, etc.) position within the device.
I/O Element
An IOE contains a bidirectional I/O buffer and a register that can be used
either as an input register for external data that requires a fast setup time,
or as an output register for data that requires fast clock-to-output
performance. IOEs can be used as input, output, or bidirectional pins. The
MAX+PLUS II Compiler uses the programmable inversion option to
automatically invert signals from the row and column interconnect where
appropriate. Figure 10 shows the IOE block diagram.
IOE
LAB
A1
LAB
A2
LAB
B1
LAB
B2
LAB Local
Interconnect
Column
Interconnect
Row
Interconnect
Cascade &
Carry Chain
IOE
See Figure 11
for details.
See Figure 12
for details.
1
8
1
8
1
8
IOE
1
8
IOE
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