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参数资料
| 型号： | EPM3128ATC144-5N |
| 厂商： | Altera |
| 文件页数： | 23/46页 |
| 文件大小： | 0K |
| 描述： | IC MAX 3000A CPLD 128 144-TQFP |
| 产品变化通告： | Bond Wire Change 4/Sept/2008 |
| 标准包装： | 180 |
| 系列： | MAX® 3000A |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 5.0ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 8 |
| 宏单元数： | 128 |
| 门数： | 2500 |
| 输入/输出数： | 96 |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-TQFP（20x20） |
| 包装： | 托盘 |
| 产品目录页面： | 603 (CN2011-ZH PDF) |
| 其它名称： | 544-1985 EPM3128ATC144-5N-ND |
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Altera Corporation
3
MAX 3000A Programmable Logic Device Family Data Sheet
The MAX 3000A architecture supports 100% transistor-to-transistor logic
(TTL) emulation and high–density small-scale integration (SSI),
medium-scale integration (MSI), and large-scale integration (LSI) logic
functions. The MAX 3000A architecture easily integrates multiple devices
ranging from PALs, GALs, and 22V10s to MACH and pLSI devices.
MAX 3000A devices are available in a wide range of packages, including
PLCC, PQFP, and TQFP packages. See Table 3.
Note:
(1)
When the IEEE Std. 1149.1 (JTAG) interface is used for in–system programming or
boundary–scan testing, four I/O pins become JTAG pins.
MAX 3000A devices use CMOS EEPROM cells to implement logic
functions. The user–configurable MAX 3000A architecture accommodates
a variety of independent combinatorial and sequential logic functions.
The devices can be reprogrammed for quick and efficient iterations
during design development and debugging cycles, and can be
programmed and erased up to 100 times.
Table 2. MAX 3000A Speed Grades
Device
Speed Grade
–4
–5
–6
–7
–10
EPM3032A
vv
v
EPM3064A
vv
v
EPM3128A
vv
v
EPM3256A
vv
EPM3512A
vv
Table 3. MAX 3000A Maximum User I/O Pins
Device
44–Pin
PLCC
44–Pin
TQFP
100–Pin
TQFP
144–Pin
TQFP
208–Pin
PQFP
256-Pin
FineLine
BGA
EPM3032A
34
EPM3064A
34
66
EPM3128A
80
96
98
EPM3256A
116
158
161
EPM3512A
172
208
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PDF描述 |
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