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参数资料
型号： EPM3128ATC144-5N
厂商： Altera
文件页数： 28/46页
文件大小： 0K
描述： IC MAX 3000A CPLD 128 144-TQFP
产品变化通告： Bond Wire Change 4/Sept/2008
标准包装： 180
系列： MAX® 3000A
可编程类型： 系统内可编程
最大延迟时间 tpd(1)： 5.0ns
电压电源 - 内部： 3 V ~ 3.6 V
逻辑元件/逻辑块数目： 8
宏单元数： 128
门数： 2500
输入/输出数： 96
工作温度： 0°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 144-LQFP
供应商设备封装： 144-TQFP（20x20）
包装： 托盘
产品目录页面： 603 (CN2011-ZH PDF)
其它名称： 544-1985
EPM3128ATC144-5N-ND
34
Altera Corporation
MAX 3000A Programmable Logic Device Family Data Sheet
tSU
Register setup time
1.4
2.1
2.9
ns
tH
Register hold time
0.6
1.0
1.3
ns
tRD
Register delay
0.8
1.2
1.6
ns
tCOMB
Combinatorial delay
0.5
0.9
1.3
ns
tIC
Array clock delay
1.2
1.7
2.2
ns
tEN
Register enable time
0.7
1.0
1.3
ns
tGLOB
Global control delay
1.1
1.6
2.0
ns
tPRE
Register preset time
1.4
2.0
2.7
ns
tCLR
Register clear time
1.4
2.0
2.7
ns
tPIA
PIA delay
(2)
1.4
2.0
2.6
ns
tLPA
Low–power adder
(5)
4.0
5.0
ns
Table 22. EPM3256A External Timing Parameters
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
–7
–10
Min
Max
Min
Max
tPD1
Input to non–registered
output
C1 = 35 pF (2)
7.5
10
ns
tPD2
I/O input to non–registered
output
C1 = 35 pF (2)
7.5
10
ns
tSU
Global clock setup time
(2)
5.2
6.9
ns
tH
Global clock hold time
(2)
0.0
ns
tCO1
Global clock to output
delay
C1 = 35 pF
1.0
4.8
1.0
6.4
ns
tCH
Global clock high time
3.0
4.0
ns
tCL
Global clock low time
3.0
4.0
ns
tASU
Array clock setup time
(2)
2.7
3.6
ns
tAH
Array clock hold time
(2)
0.3
0.5
ns
tACO1
Array clock to output delay C1 = 35 pF (2)
1.0
7.3
1.0
9.7
ns
tACH
Array clock high time
3.0
4.0
ns
tACL
Array clock low time
3.0
4.0
ns
tCPPW
Minimum pulse width for
clear and preset
(3)
3.0
4.0
ns
Table 21. EPM3128A Internal Timing Parameters (Part 2 of 2)
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
–5
–7
–10
Min
Max
Min
Max
Min
Max
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PDF描述
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参数描述
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EPM3128ATC144-7N 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX 3000A 128 Macro 96 IOs RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100
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