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参数资料
| 型号： | EPM7128AETC100-4 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | EE PLD, 4.5 ns, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 1/51页 |
| 文件大小： | 1559K |
| 代理商： | EPM7128AETC100-4 |
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Altera Corporation
595
MAX 7000A
Programmable Logic
Device Family
June 1999, ver. 2.01
Data Sheet
A-DS-M7000A-02.01
Includes
MAX 7000AE
Features...
s
High-performance CMOS EEPROM-based programmable logic
devices (PLDs) built on second-generation Multiple Array MatriX
(MAX) architecture (see Table 1)
s
3.3-V in-system programmability (ISP) through the built-in
IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface with
advanced pin-locking capability
Preliminary
Information
s
Built-in boundary-scan test (BST) circuitry compliant with
IEEE Std. 1149.1-1990
s
Enhanced ISP features
–
Enhanced ISP algorithm for faster programming (excluding
EPM7128A and EPM7256A devices)
–
ISP_Done bit to ensure complete programming (excluding
EPM7128A and EPM7256A devices)
–
Pull-up resistor on I/O pins during in-system programming
s
Pin-compatible with the popular 5.0-V MAX 7000S devices
s
High-density PLDs ranging from 600 to 10,000 usable gates
s
4.5-ns pin-to-pin logic delays with counter frequencies of up to
192.3 MHz
f For information on in-system programmable 5.0-V MAX 7000 or 2.5-V
MAX 7000B devices, see the MAX 7000 Programmable Logic Device Family
Data Sheet or the MAX 7000B Programmable Logic Device Family Advance
Information Brief.
Table 1. MAX 7000A Device Features
Feature
EPM7032AE
EPM7064AE
EPM7128AE
EPM7128A
EPM7256AE
EPM7256A
EPM7512AE
Usable gates
600
1,250
2,500
5,000
10,000
Macrocells
32
64
128
256
512
Logic array blocks
2
4
8
16
32
Maximum user I/O
pins
36
68
100
164
212
tPD (ns)
4.5
5.0
6.0
7.5
tSU (ns)
3.0
3.2
3.7
4.9
tFSU (ns)
2.5
3.0
tCO1 (ns)
2.8
3.0
3.3
4.5
fCNT (MHz)
192.3
181.8
156.3
119.0
相关PDF资料 |
PDF描述 |
|---|---|
| EPM7128AETC100-6 | EE PLD, 6 ns, PQFP100 |
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